登录
首页 » VHDL » Quartus II VHDL语言8分频器计数器

Quartus II VHDL语言8分频器计数器

于 2022-06-12 发布 文件大小:6.13 MB
0 105
下载积分: 2 下载次数: 1

代码说明:

分频计数器是指对信号进行分频处理的计数器,分频分偶数和奇数分频两种。VHDL主要用于描述 数字系统的结构,行为,功能和接口。除了含有许多具有硬件特征的语句外,VHDL的语言形式、描述风格以及语法是十分类似于一般的 计算机高级语言。VHDL的程序结构特点是将一项工程设计,或称设计实体(可以是一个元件,一个电路模块或一个系统)分成外部(或称可视部分,及端口)和内部(或称不可视部分),既涉及实体的内部功能和算法完成部分。在对一个设计实体定义了外部界面后,一旦其内部开发完成后,其他的设计就可以直接调用这个实体。这种将设计实体分成内外部分的概念是VHDL 系统设计的基本点。

下载说明:请别用迅雷下载,失败请重下,重下不扣分!

发表评论

0 个回复

  • 在nexys2数字cronometer
    该项目是用VHDL编写的,并在Nexys2板套件的4个七段显示器中显示一个测微计的秒、分和小时。时间可以在开关0中停止,在按钮0中复位。显示方式与显示方式不同最小:分段到hr:min通过切换开关1
    2022-11-12 07:55:03下载
    积分:1
  • FM_T
    一个简单的FM调制模块,FM发射,用Verilog编写,基于Xilinx SPARTAN6 XC6LX9开发(A simple FM modulation modules for FM transmitter, using Verilog prepared, based on XILINX SPARTAN6 XC6LX9 Development)
    2020-11-25 20:19:32下载
    积分:1
  • DE2_CCD
    说明:  此程序用来实现图像的采集和帧数的计算功能。(Image acquisition and calculation of the number of frames.)
    2011-04-17 09:43:37下载
    积分:1
  • Sequence Detection VHDL source code, ATERA platform compile. Report detailed des...
    序列检测VHDL源代码,ATERA平台编译。详细的报表说明和模拟源代码。
    2022-10-18 04:30:03下载
    积分:1
  • 以前学习VHDL语言时做的一个电子闹钟程序,可以实现时,分,秒的计时以及定时,校时,闹钟,整点报时的功能。...
    以前学习VHDL语言时做的一个电子闹钟程序,可以实现时,分,秒的计时以及定时,校时,闹钟,整点报时的功能。-VHDL language before learning to do procedures in an electronic alarm clock, you can realize hours, minutes and seconds of time and from time to time, school time, alarm clock, the whole point timekeeping function.
    2022-05-06 21:47:35下载
    积分:1
  • Auto Gain Control详细代码 AGC-simulink
    這裡提供Auto Gain Control 的詳細代碼與功能介紹(Here are details of the code and the Auto Gain Control Functions)
    2014-01-21 14:14:57下载
    积分:1
  • project_1
    说明:  简单的一个Verilog小程序,适合刚接触的人群(A simple Verilog small program, suitable for people just contact)
    2020-06-16 22:20:01下载
    积分:1
  • 整个工程代码
    掌握SDRAM数据读写、刷新、初始化以及FPGA串口收发时序,熟练FIFO IP核的生成和调用。(Master SDRAM data read and write, refresh, initialization and the timing of sending and receiving of the serial port of the FPGA, skilled in the generation and invocation of the FIFO IP core.)
    2019-01-21 17:21:27下载
    积分:1
  • cyclone and cyclone2 system used in the use 5v, making FPGA chip compatible with...
    cyclone和cyclone2用在5v系统里使用方法,使得FPGA芯片在5V系统中兼容-cyclone and cyclone2 system used in the use 5v, making FPGA chip compatible with the 5V system
    2022-02-03 17:24:31下载
    积分:1
  • reference
    早迟门(early late gate),比特同步算法,该文档详细的说明了早迟门算法的原理以及具体的实现步骤(Early late gate (early late gate), bit synchronization algorithm, the document explains in detail the principles of early-late gate method and the specific implementation steps)
    2015-04-30 15:06:04下载
    积分:1
  • 696518资源总数
  • 105895会员总数
  • 18今日下载