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feibonacc序列产生模块
斐波那契数列序列产生模块，对于学习有限状态机(FSM)和数据通道(FSMD)的朋友来说很有用处，包括斐波那契数列的产生模块以及测试模块，
- 2023-03-07 02:50:03下载
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adder4
四位加法器 数码管显示 组合电路 verilog(adder4 smg display combitional circuit verilog)
- 2013-02-28 09:56:46下载
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pe1lca
vhdl code for programming
- 2012-11-22 21:37:52下载
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bp
说明： 基于BP算法的LDPC译码程序，采用vhdl语言，bp算法(BP algorithm based on LDPC decoding program using vhdl language, bp algorithm)
- 2016-04-12 16:59:55下载
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Roy dsd
说明： basic verilog code on siso, piso, sipo
- 2020-06-25 18:40:01下载
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spartan6_GTP
基于xilinx公司的SPARTAN6系列芯片的高速全双工串行收发器(high-speed transceiver based on spartan 6 of Xilinx PFGA)
- 2018-03-08 23:14:30下载
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LFM
该程序使用Verilog语言产生LFM信号(The program uses Verilog language to generate LFM signals.)
- 2021-04-19 09:38:51下载
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第五部分 按键检测例程
在电子产品中我们会经常用到按键，比如电脑的键盘，手机的按键等等，按键就是人机交互的一种工具。在AX309开发板上有四个用户按键供用户使用和体验，用户可以使用FPGA程序来检测与按键对应的 I/O 口的电平高低来判断按键是否按下或松开。
本实验内容将介绍按键的检测及按键的防抖的程序设计，通过点亮/点灭开发板上相应的LED灯来指示按键的动作。
按键１按一下-------------LED1反转；
按键2按一下-------------LED2反转；
按键3按一下-------------LED3反转；
按键4按一下-------------LED4反转；
- 2022-02-15 15:41:03下载
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generate-coordinates
使用VHDL编写语言，巧妙的利用计数器和循环输出一个坐标系，由于VHDL出现负数比较麻烦，全部由正数代替，输出一个原点在中心，半径128的256×256的坐标。方便坐标变换以及用此坐标做算法。(Use of VHDL language, clever use of counter and loop outputs a coordinate system, because VHDL negative too much trouble, all replaced by a positive number, the output an origin at the center, radius 128 256 256 coordinates. Convenient coordinate transformation and coordinate to do with this algorithm.)
- 2013-08-28 11:03:46下载
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Multiplier
圖形介面乘法器,也可自行使用verilog去改(Graphical interface multiplier, also free to use verilog go and change)
- 2012-10-25 21:12:49下载
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