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16QAM-modulation-based-on-FPGA
基于FPGA的16QAM调制程序,基于verilog开发环境(16QAM modulation program based on FPGA-based development environment verilog)
- 2014-05-07 14:05:25下载
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FPGA_merge
关于FPGA排序算法的研究文献，有全排序和一些归并算法的文献介绍。(FPGA sequencing algorithm on the literature, there are some sort of sorting algorithm and the literature on the merger.)
- 2016-11-22 21:12:56下载
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浮点单元
本文档介绍了Verilog双精度浮点内核，这些
- 2023-03-23 11:50:04下载
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uart-gen.rar
uart-gen.rar,是关于异步通信的1.在内部环路测试没有问题，逻辑应该基本是没有问题的。但是如果转成外部通讯的话，看一下数据输入和输出时候的同步性。
2.用逻辑分析仪或者chipscope抓一下错误的数据，看能不能找到错误发生的规律。
3.请关注一下波特率的设置：在内部测试的时候是不是和外面接收时候一样，注意到波特率和频率的关系。
4.将ucf里面io试着换一下，查一下io的驱动能力，还有io最好不要悬空，接弱上拉看看。
- 2022-01-25 21:16:56下载
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LMS_filter
这是自适应滤波器，使用verilog代码来编写的，已通过了仿真，效果很好。希望能给大家好好分享！(This adaptive filter verilog code to write, through a simulation, with good results. I hope to give a good share!)
- 2020-12-08 21:19:19下载
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uart
可以进行连续uart串口读写999次以上不出错，已经检测成功(It can read and write serial UArt more than 999 times without error. It has been detected successfully.)
- 2020-06-15 22:50:02下载
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xilinx平台DDR3设计教程之仿真篇_中文版教程
DRD3在Xlinix平台上的设计教程以及仿真(DRD3 design tutorial and Simulation on Xlinix platform)
- 2018-11-02 11:18:06下载
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RISC 微控制器
RISCMCU 基于功能和 Atmel AVR AT90S1200 RISC 微控制器指令集。
该项目的目的是设计完整的 Atmel AVR AT90S1200。的
微控制器必须能够放入该有针对性的 FPGA 设备，是 Altera
EPF10K20，在 Altera UP1 教育董事会中提供。不能的功能
在 FPGA (模拟比较器、 上拉电阻等) 和哪些不实施
关键的 CPU （看门狗重启等） 的操作将被忽略。
- 2022-07-09 11:32:13下载
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stopwatch
数字秒表的VHDL代码。当设计文件加载到目标器件后，设计的数字秒表从00-00-00开始计秒。，直到按下停止按键（按键开关S2）。数码管停止计秒。按下开始按键（按键开关S1），数码管继续进行计秒。按下复位按键（核心板上复位键）秒表从00-00-00重新开始计秒。(The VHDL code for digital stopwatch. When the design document loaded into the target device, the designed digital stopwatch count the seconds from the 00-00-00. Until you press stop key (key switch S2). Nixie tube stop count seconds. Press the start button (key switch S1), the digital control continue to count seconds. Press the reset button (core panel reset button) to restart the stopwatch count seconds from the 00-00-00.)
- 2010-03-02 17:17:58下载
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nand flash控制器的设计
- 2022-11-20 17:00:03下载
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