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Verilog Booth 型乘法器

于 2022-08-21 发布 文件大小:335.15 kB
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代码说明:

此文件描述的 verilog booth 型乘法器的代码。源代码是模拟和验证效果会更好

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  • altera 以太网
    资源描述利用ALTERA FPGA+DM9000实现以太网通讯,包过DM9000驱动,DE2开发板的应用范例,简化的TCP/IP协议,以及各种相关论文
    2022-03-23 19:01:16下载
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  • PMW风扇驱动
    该模块依据输入的温度,来自动调整PWM输出的占空比,从而进行CPU散热风扇的智能调速,温度需要上层软件往该模块中下发。
    2022-07-18 05:43:14下载
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  • util_gmii_to_rgmii
    说明:  rgmii代码编写,实现rgmii接口功能,可进行参考设计(The rgmii code is written to realize the function of rgmii interface, which can be used for reference design)
    2021-03-18 10:19:20下载
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  • Simulate
    FPGA控制AD逐点采集信号,并将AD转换后的数据串行发送出去。(FPGA to control the signal sampling point by point AD, AD conversion and serial data sent.)
    2021-04-14 21:08:55下载
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  • Sobel 边缘检测
    Sobel 边缘检测 DE2i 150 气旋 IV fpga 与友晶相机而产生-D5M 与不同的阈值。捕获的图像是的 < 跨风格 ="字体-搜索 ; 字体系列:""> 这 pojects 介绍了灰度、 二进制文件、 焊缝和数学形态学。 还描述了本文,即扩张,侵蚀,合闸和分闸的方法。 800 x 600 的分辨率。本文提供的所有操作结果执行本文数目与旋流器的输入 images(800x600) IV DE2i 150 和友晶而产生 D5M 使用 Verilog 编码 inQuartus II 12.1。 FPGA 使得实时焊缝和数学形态学由于其快速的计算成为可能。
    2022-01-28 16:32:21下载
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  • viterbi
    viterbi decode by verilog
    2019-06-18 00:55:40下载
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  • fft64
    使用两个8点FFT完成64-point FFT(64-point FFT)
    2013-01-15 04:57:52下载
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  • ANALYSIS-OF-FULL-ADDER
    DESCRIPTION OF FULL ADDER
    2013-11-12 13:32:19下载
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  • modelsim_gaosi
    说明:  用matlab将图片转成灰度图TXT,再通过verilog将数据导入FPGA中,采用高斯滤波算法来处理,再将处理后的图片数据导出到TXT中。(The image is transformed into gray-scale image TXT by MATLAB, and then the data is imported into FPGA by Verilog, processed by Gauss filter algorithm, and then the processed image data is exported to TXT.)
    2020-05-28 16:20:09下载
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  • lut_multiplier
    使用verliog设计实现LUT查找表乘法器,通过modelsim仿真验证通过(Designed and implemented using the LUT lookup table verliog multipliers, through simulation by modelsim)
    2021-04-09 10:18:59下载
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