登录
首页 » VHDL » This document is formatted UltraEdit document describes some of the original Ult...

This document is formatted UltraEdit document describes some of the original Ult...

于 2022-09-16 发布 文件大小:31.16 kB
0 104
下载积分: 2 下载次数: 1

代码说明:

这个文件中是UltraEdit的一些格式化文件说明 由于原来的 UltraEdit 不支持 HDL 语言的格式化显示,把文件解压得到的 wordfile.txt替换其安装目录下的 wordfile.txt 文件即可-This document is formatted UltraEdit document describes some of the original UltraEdit as a result of HDL does not support formatting language shows that the document received decompression wordfile.txt replace its installation directory under the document can wordfile.txt

下载说明:请别用迅雷下载,失败请重下,重下不扣分!

发表评论

0 个回复

  • 2。你可以以任何方式使用这个核心,无论是学术,商业,或
    2. You may use this core in any way, be it academic, commercial, or -- military. Modified or not.-2. You may use this core in any way, be it academic, commercial, or-- military. Modified or not.
    2022-02-15 13:22:40下载
    积分:1
  • BISS-B---Stimulate_OK
    BISS-B 源代码。包含传感器模式和寄存器模式(BISS-B source code. Includes sensor mode and register mode)
    2021-03-15 19:29:22下载
    积分:1
  • SCAN_LED
    基于EDA技术中的对LED扫描电路的实验,程序能成功运行,能直接在开发板上看实验结果(EDA-based LED technology to scan the experimental circuit, the program can run successfully, can see directly in the development of on-board results)
    2009-06-05 11:49:53下载
    积分:1
  • oled
    驱动0.96寸的oled显示数字和字母,(Drive 0.96 inch OLED to display numbers and letters.)
    2021-01-14 16:28:46下载
    积分:1
  • 2通道ADC Ads527x的采集实现Vhdl
    2通道模数转换器的采集实现。包含VIRTEX-II 和SPARTAN-III 两种类型的FPGA元件,模数转换器件为ADS527X系列,含仿真代码。采用VHDL语音实现,具有参考价值。
    2022-01-20 23:16:05下载
    积分:1
  • VHDL实现二维DCT变换
    本程序利用VHDL实现二维离散余弦变换,经本人测试,在Quartus II7.0软件上可正确仿真,希望大家积极采纳
    2022-02-06 07:06:17下载
    积分:1
  • dividefrequency
    如何用VHDL语言对时钟进行分频以达到计数目的(how to achive counting by VHDL Language)
    2009-02-13 15:45:38下载
    积分:1
  • VHDL语言,设计一个在DE2平台的8个七段数码管上循环显示HELLO的程序
    VHDL语言,设计一个在DE2平台的8个七段数码管上循环显示HELL0的程序,采用按键控制循环的速度,慢速循环时间间隔为1S,快速循环时间间隔为200ms。(VHDL language, design a platform in the DE2 8 segment digital tube display HELL0 program cycle, the speed control loop using keys, slow cycle time interval for the 1S, fast cycle time interval is 200ms.)
    2020-07-08 20:28:56下载
    积分:1
  • CPU
    使用QuartusII软件,利用VHDL语言设计实现CPU,其中包含时序图仿真。(Using software QuartusII, using VHDL language to design the CPU, which contains sequence diagram simulation.)
    2015-07-22 16:23:52下载
    积分:1
  • VHDL
    产生svpwm波形,可以参考下载,以便学习交流(gennerate SVPWM wave)
    2017-11-21 15:38:29下载
    积分:1
  • 696518资源总数
  • 105547会员总数
  • 4今日下载