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串口模块程序，可以实现串行发送和接收功能，比特率可以不断调整，数据的长度是可以改变的...

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串口模块程序，可以实现串行发送和接收功能，比特率可以不断调整，数据的长度是可以改变的-Serial port module program, you can achieve the serial send and receive functions, and bit rate can be continuously adjusted, the data length can be changed

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LIP4210CORE_SDIO
SDIO Verilog Sourcw code

2021-04-29 12:58:43下载

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不同加法器 vhdl 代码
乘数是其中一个关键硬件块在大多数数字和高性能系统中如 FIR 滤波器、数字信号处理器和微处理器等。随着技术的进步，许多研究者试过和正在尝试设计提供或者以下高速度、低功耗、规律的布局的乘数，从而较少的地区或在乘数的他们甚至组合。从而使它们适合于各种高速度、低功耗，和紧凑的超大规模集成电路的实现。然而面积和速度是两个相互冲突的约束。所以提高速度结果总是在较大的地区。所以在这里我们尝试找出解决方案了他们两个之间的最佳贸易。一般我们所知乘法会中两个基本步骤。部分产品，然后添加。因此在这个项目中我们有第一次尝试设计不同加法器和比较它们的速度和复杂性的电路即占领的地区。

2022-04-20 15:21:48下载

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codeloc1k
说明：实现电子密码锁的各项功能,经过编译和仿真(Electronic code lock of the function, the compiler and simulation)

2008-11-09 21:24:14下载

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signalintegrity
信号完整的一些总结，非常实用，适合开始着使用(A book for signal integrated)

2014-08-08 16:45:47下载

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mvb_altera_may-02
altera mvb fpga sopc 设计参考文档，有一定价值(mvb fpga sopc Design scheme)

2015-01-15 17:15:33下载

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我是VHDL的初学者，这是我自己编译的简单的几个VHDL码，功能有3...
我是VHDL的初学者，这是我自己编译的简单的几个VHDL码，功能有3-8解码器及其testbench,16位寄存器及其testbench和交通灯。希望能和其他初学者一起讨论学习，并得到高手的指点-I VHDL beginners, this is my own translation of a few simple VHDL code. 3-8 function decoder and testbench, 16 Register and testbench and traffic lights. Hopes to be able to discuss other beginners learning, and with the guidance of the master

2022-05-14 07:13:44下载

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dw_ahb_dmac_db
It is Synopsys dmac controller databook

2020-10-10 10:27:34下载

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01-USB
usb读取，仅供参考，在实际应用中要更改以下数据。(Read usb data)

2012-12-24 15:35:40下载

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uart
串口通信通用模块，FPGA Verilog语言 ise，vivado环境(uart,FPGA Verilog, ise,vivado)

2020-06-22 07:20:01下载

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fifo_ref_timing
first in first out 的说明文档以及时序图对学习FIFO很有帮助(first in first out the documentation and the timing diagram helpful in learning FIFO)

2010-07-21 21:43:36下载

积分：1

696516资源总数
106415会员总数
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串口模块程序，可以实现串行发送和接收功能，比特率可以不断调整，数据的长度是可以改变的...

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