登录
首页 » Verilog » iic程序

iic程序

于 2022-11-19 发布 文件大小:64.65 kB
0 153
下载积分: 2 下载次数: 1

代码说明:

这是IIc才程序,验证完成,可以直接复用,不许更改,有详细的文档介绍,和对应的代码

下载说明:请别用迅雷下载,失败请重下,重下不扣分!

发表评论

0 个回复

  • FPGA_SPWM
    此代码是由FPGA产生SPWM波的代码,简单易懂(use FPGA to generate SPWM)
    2019-02-19 16:12:33下载
    积分:1
  • Apply-of-turbo-code-in-LTE
    turbo码在LTE中的实现,并在fpga中得到了实现(turbo code in LTE implementations, and have been achieved in fpga)
    2021-01-14 20:28:46下载
    积分:1
  • EDAandVHDL
    EDA技术与VHDL课件,利用EDA技术进行电子系统设计(EDA technology and VHDL courseware, the use of EDA technology for electronic system design)
    2009-03-04 15:34:53下载
    积分:1
  • 21452547
    加减可控制的十到十六进制计数器。完全准确,可以放心使用的(Add and subtract controllable ten to hexadecimal counter. Entirely accurate, can be at ease of use)
    2016-01-11 12:46:04下载
    积分:1
  • inverter chain
    说明:  基于HSPICE实现的反相器链,并分析电路延时(Inverter chain based on HSPICE, and analyze circuit delay)
    2020-04-21 12:55:52下载
    积分:1
  • 同步FIFO verilog
    2022-03-18 10:42:06下载
    积分:1
  • cloc
    时钟在单片机中的应用,用于控制中断及显示程序(Clock in the MCU application, used to control interrupt and display program)
    2013-06-04 15:27:35下载
    积分:1
  • ieee1588_megacore_fpga_ip
    IEEE1588de FPGA 程序,已测试,可直接用,方便(IEEE1588de FPGA program has been tested, can be directly used to facilitate)
    2021-03-26 11:59:13下载
    积分:1
  • aynchronous fifo 项目
    先入先出 (FIFO) 内存结构广泛用于缓冲处理块之间的数据传输。高性能、 高复杂度数字系统越来越多地被要求不同的模块之间传输数据,甚至不相关的时钟频率。双时钟 FIFO 是一个更复杂的函数,可提供高速数据缓冲对于异步时钟域应用程序。建议的设计利用了一种有效的内存数组结构,并可以运行在应用程序中存在多个时钟周期的延迟时间的地方。它还包括一个可配置的同步电路,同步异步信号 FIFO 内。
    2022-04-30 19:05:35下载
    积分:1
  • FPGA驱动VGA显示彩条
    FPGA驱动VGA在电脑显示屏上显示彩条                                                                                                                        附有注释
    2022-01-22 02:34:25下载
    积分:1
  • 696516资源总数
  • 106641会员总数
  • 4今日下载