登录
首页 » VHDL » altera公司cpld/fpga开发软件quartus2中文使用教程

altera公司cpld/fpga开发软件quartus2中文使用教程

于 2022-11-23 发布 文件大小:2.96 MB
0 136
下载积分: 2 下载次数: 1

代码说明:

altera公司cpld/fpga开发软件quartus2中文使用教程-altera company cpld/fpga development of software to use Chinese quartus2 Guide

下载说明:请别用迅雷下载,失败请重下,重下不扣分!

发表评论

0 个回复

  • shuzishizhong
    这是基于verilog hdl的数字时钟源代码,能够实现时分秒的计时,可以手动进行调时与调分。(This is based on the digital clock verilog hdl source code, can be achieved when every minute of the time, you can adjust the time manually adjusting points.)
    2013-12-10 22:21:55下载
    积分:1
  • AV视频信号输入后,存入SDRAM中然后在PC上面进行显示的代码。...
    AV视频信号输入后,存入SDRAM中然后在PC上面进行显示的代码。-AV video signal input into the SDRAM in the PC and then display the code above.
    2023-03-27 03:30:03下载
    积分:1
  • verilog___UART
    Verilog 编写的串口通信模块 带测试代码(Verilog prepared by the serial communication module with a test code)
    2012-05-24 20:38:27下载
    积分:1
  • 周立公Verilog
    关于verilog的知识点和关键点的总结(Summary of knowledge points and key points of Verilog)
    2020-07-01 22:20:02下载
    积分:1
  • keyscan
    利用VHDL语言编写的4*4键盘扫描程序,经过测试,可以放心使用。(Using VHDL language 4* 4 keyboard scanning procedures, tested, safe to use.)
    2013-09-28 21:48:45下载
    积分:1
  • vivado 从此开始配套资料
    vivado入门使用介绍,初学者入门学习(vivado Instructional pdf)
    2020-07-04 18:00:01下载
    积分:1
  • 这是一个LCD驱动的VHDL代码
    this a LCD Driver VHDL code -this is a LCD Driver VHDL code
    2022-03-17 09:49:14下载
    积分:1
  • RS_Encode_Decode
    RS(255,223)编解码算法。verilogHDL代码实现,在XILINX的芯片上得到验证。不包含任何IP核,方便移植到任何FPGA芯片。(RS (255223) encoding and decoding algorithm. VerilogHDL code to achieve, in the XILINX chip to be verified. Does not contain any IP core, easy to transplant to any FPGA chip.)
    2016-01-21 12:07:34下载
    积分:1
  • 语音采集,直接在QUARTUSII中打开调试.
    语音采集,直接在QUARTUSII中打开调试.-err
    2022-01-22 11:44:02下载
    积分:1
  • hand_shake
    握手程序,可以完美实现跨时钟域的数据传输(handshake and testbench,verilog HDL)
    2011-11-22 21:05:38下载
    积分:1
  • 696518资源总数
  • 106164会员总数
  • 18今日下载