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用AHDL语言编写,MAXPULS开发.通信不受外部时钟速率和数据字节数目限制....

于 2022-12-17 发布 文件大小:1.46 kB
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用AHDL语言编写,MAXPULS开发.通信不受外部时钟速率和数据字节数目限制.-with AHDL prepared MAXPULS development. Communications from external clock rate and restriction on the number of data bytes.

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  • 240188modified-rom-based-logic
    Modified rom based logic
    2016-04-01 09:48:45下载
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  • compa
    comparator code for micarowind
    2015-03-28 17:18:49下载
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  • myDPll
    说明:  本人写的数字锁相环,有模拟数据,学习锁相环很好的材料。参考书“数字锁相环路原理与应用”编写。(I write the digital phase-locked loop, have simulated data, a good phase-locked loop learning materials. Reference book )
    2008-08-29 08:54:53下载
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  • cordic
    基于cordic算法的DDS的Verilog代码。经过仿真验证,绝对可靠。(Based on cordic algorithm DDS Verilog code. Through the simulation, is absolutely reliable.)
    2013-12-20 17:22:38下载
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    这是一个设计可以执行二进制的十进制数转换的组合电路中的练习 和二进制-编码-十进制 (BCD) 加法。
    2022-01-24 12:56:55下载
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  • 犯错
    KX_DVP3F型FPGA应用板/开发板(全套)包括:  CycloneII系列FPGA EP2C8Q208C8 40万们,含20M-270MHz锁相环2个。  RS232串行接口;VGA视频口  高速SRAM 512KB。可用于语音处理,NiosII运行等。  配置Flash EPCS2, 10万次烧写周期 。  isp单片机T89S8253:MCS51兼容单片机,12KB在系统可编程Flash ROM,10万次烧 写周期;2KB在系统可编程EEPROM,10万次烧写周期;2.7V-5.5V工作电压;0-24MHz 工作时钟;  2数码管显示器、20MHz时钟源(可通过FPGA中的锁相环倍频);  液晶显示屏(20字X4行);  工作电源5V、3.3V、1.2V混合电压源,良好电磁兼容性主板。  配套示例程序、资料、编程软件光盘等。  4X4键盘,4普通按键,8可锁按键,8发光管  BlasterMV编程下载器和并口通信线,可完成FPGA编程下载和isp单片机的编程。KX_DV3F开发板的源程序-err
    2022-02-10 08:39:49下载
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  • 123.rar
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