登录
首页 » Verilog » 用VERILOG编写的USB2.0源代码

用VERILOG编写的USB2.0源代码

于 2023-01-14 发布 文件大小:192.03 kB
0 121
下载积分: 2 下载次数: 1

代码说明:

基于Verilog Hdl语言实现的USB2.0通信模块。

下载说明:请别用迅雷下载,失败请重下,重下不扣分!

发表评论

0 个回复

  • PWM
    verilogHDL语言编写,简单的FPGA脉冲程序,初学者必备。(verilogHDL language, a simple FPGA pulse program, beginners must.)
    2012-12-27 11:54:45下载
    积分:1
  • LEDcontrol
    fpga控制led灯的闪烁,内容简单,希望对初学者有用.(fpga control led lights flashing, the content is simple, I hope useful. . .)
    2015-05-05 10:00:11下载
    积分:1
  • ix746
    Nonlinear discrete system identification, It uses a pulse of consumer law, Partial least squares method.
    2017-08-28 20:46:28下载
    积分:1
  • Altera FPGA配置AD5300 Verilog代码
    Altera FPGA 利用SPI口配置外部DACAD5300的Verilog代码,代码经调试后运行稳定。友情提示,由于本人水平有限,代码不可避免存在问题,敬请谅解
    2022-09-05 02:50:03下载
    积分:1
  • 基于spartan 3e 的lcd显示屏驱动
    该程序用verilog语言描写了一段驱动spartan 3e 板子上的1602 lcd 显示屏驱动程序包含其中,其中第一行显示level score life. 第二行显示00,01 03 时钟选择板子上自带的50m时钟。 驱动严格按照时序来写双航显示。
    2022-01-26 06:11:11下载
    积分:1
  • 序列检测器的实现采用Verilog HDL模拟使用ModelSim
    2023-01-19 03:45:03下载
    积分:1
  • newViterbi217
    基于IEEE802.11n标准,采用verilog语言设计的(2,1,7)卷积码viterbi译码器,支持1/2,2/3,3/4,5/6四种码率的译码,以测试无误(IEEE802.11n standard Verilog language design (2,1,7) convolutional code viterbi decoder support 1/2, 2/3, 3/4, 5/6 four bit rate decoding to test and correct)
    2020-06-29 08:40:01下载
    积分:1
  • 乘数 2 位数 4 位
    这是乘数 2 位数 4 位,第 4 部分实验室 6-行使的 Altera DE2 工具包的解决方案 乘数包括 2 位数 4 位输入,我使用的开关SW11−8 代表人数A 和交换机SW3−0 来表示 B.的十六进制值 A 和 B 都要上 7 段显示显示 HEX6 和 HEX4, 分别。结果 P = × B 是要显示在HEX1和HEX0上。 请点击左侧文件开始预览 !预览只提供20%的代码片段,完整代码需下载后查看 加载中 侵权举报
    2022-07-05 01:13:31下载
    积分:1
  • DE0_VGA
    利用FPGA设计游戏设计,真人版超级玛丽,VGA显示(Using FPGA design game design, live-action version of Super Mario, VGA display)
    2020-11-06 13:09:55下载
    积分:1
  • electrical lock
    一个用Verilog写的电子锁工程,带testbench。(An electronic lock project written in Verilog with testbench.)
    2020-06-30 05:00:01下载
    积分:1
  • 696518资源总数
  • 105908会员总数
  • 30今日下载