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FPGA实现DE2-115开发板上SD-CARD读写访问

于 2023-01-27 发布 文件大小:3.02 MB
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代码说明:

ALtera DE2-115 开发板,实现SD-CARD的读写,直接硬件实现,未使用IP核的形式EDA工具:quartus ii硬件描述语言:Verilog HDL未使用嵌入式内核NIOS ii,未使用软件平台Eclipse

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  • RANGEN
    2011年全国大学生电子设计竞赛E题“简易数字信号传输性能分析仪”fpga的控制代码,verilog编写;包括了M序列及同步时钟的提取等所有程序。(2011 National Undergraduate Electronic Design Contest E title "Simple digital signal transmission performance analyzer" fpga control code, verilog prepared including the M-sequence and synchronous clock extraction and all other programs.)
    2020-10-27 17:09:59下载
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  • ripple carry adder
    这是xilix项目。它是纹波进位加法器的通用代码,其测试平台也是它们的核心。它有最小的延迟。已检查。它工作正常。
    2022-11-17 16:40:03下载
    积分:1
  • 138
    用vhdl 语言实现138译码器,用vhdl 语言实现138译码器,(vhdl vhdl vhdl vhdl vhdl vhdl vhdl vhdl vhdl vhdl vhdl vhdl vhdl vhdl vhdl vhdl vhdl )
    2009-04-21 12:32:17下载
    积分:1
  • fpga_debounce_filter
    fpga debounce filter code in vhdl
    2009-10-02 18:48:22下载
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  • Uart
    RS422通信程序,Verilog语言,此模块实现422通信功能(RS422 communication program, Verilog language, this module implements 422 communication function.)
    2021-04-07 14:59:02下载
    积分:1
  • imports
    说明:  displayport 参考设计,可以对比自己工程做验证,另有参考设计XAPP1178未找到,采用方案为DP159 + Artix7 FPGA(xilinx displayport sink design)
    2021-01-11 16:58:50下载
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  • HwLog10
    用verilog写的,基于查表法实现的LOG10运算器,在Altera FPGA中应用。(It is a verilog design of LOG10 calculation unit, which is based on LUT arithmatic. And it is applicated in Altera FPGA.)
    2021-04-07 15:59:01下载
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  • crc24_d1
    CRC24的verilog实现,LTE的3GPP 36.212里面对应的CRC添加(the implementation of CRC24 in verilog)
    2018-06-06 14:16:10下载
    积分:1
  • vhdl_codes
    D-flip flop vhdl implement code
    2012-04-13 14:03:13下载
    积分:1
  • hilbert
    用VHDL实现了希尔伯特滤波器,即就是幅度不变,而相位移动90度(use vhdl to accomplish the hilbert filter)
    2020-12-29 18:09:02下载
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