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all clock
说明： 数字钟通过verilog实现，并且支持Modelsim仿真(The digital clock is implemented by Verilog and supports Modelsim simulation)
- 2020-06-18 05:00:01下载
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FPGA芯片亚稳态参数测试代码
资源描述在FPGA器件上测试芯片的亚稳态参数的测试方法代码
- 2022-07-04 20:54:44下载
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verilog matlab iir 数字滤波器
verilog matlab iir 数字滤波器 IIR低通滤波器，matlab与verilog程序完全对应 IIR低通滤波器，matlab与verilog程序完全对应 IIR低通滤波器，matlab与verilog程序完全对应
- 2022-09-09 04:55:02下载
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基于FPGA的串口通信设计
本代码我们做的是“回环测试”，上微机首先通过串口通信发送数据到FPGA，FPGA接收到数据以后再将其发回给上位机，通过观察上位机的数据显示窗口，我们就能确定基于FPGA的串口数据手法是否正确。
- 2023-08-30 18:35:04下载
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IIC
fpga实现的IIC通信的例程，注释很详细(fpga implementation of serial communication routines, comments in great detail)
- 2021-03-24 16:29:15下载
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baseband_verilog
verilog实现的基带信号编码，整个系统分为六个模块，分别为：时钟模块,待发射模块,卷积模块,扩频模块,极性变换和内插模块,成型滤波器(verilog implementation baseband signal coding, the entire system is divided into six modules, namely: the clock module, to be launched modules, convolution module, spread spectrum modules, polarity transform and interpolation modules, forming filter)
- 2009-10-08 10:19:34下载
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基于FPGA的别踩白块儿
把安卓上的“别踩白块儿”游戏移植到了FPGA平台上，本段程序是街机模式的程序，使用VGA方式，按键控制的，用户交互方面比较好
- 2022-02-25 07:50:41下载
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FPGA基于PCIE的DMA测试
利用ISE工具，完成对v6系列的FPGA上PCIE以及DMA数据测试仿真，可以通过编译产生仿真波形，也可以根据自己的开发板烧录到自己的板子上
- 2023-08-18 13:05:05下载
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中值滤波算法
中值滤波实现。选择在Vivado软件上采用Verilog语言来编写中值滤波算法，搭建出完整的数据处理系统架构，通过仿真和验证来判断数据的处理效果，并在实际的设计过程中根据出现的问题提出解决方案。(Median filter implementation. The author chose Verilog language to write the median filter algorithm in Vivado software, built a complete data processing system architecture, judged the data processing effect through simulation and verification, and proposed a solution according to the problems in the actual design process.)
- 2018-05-30 13:44:03下载
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SERDES_handbook
SERDES资料，包括reliability_handbook,serdes_handbook,serdes_introduction(SERDES doc,include reliability_handbook,serdes_handbook,serdes_introduction)
- 2017-01-12 18:28:41下载
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