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vhdl
vhdl code for internet interface
- 2014-12-04 04:58:04下载
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CLA Verilog代码
先行进位加法器（CLA）代码的Verilog〜它包括测试平台我希望这将有助于你
- 2022-02-03 21:42:16下载
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state-machine
一个简单的用verilog实现的售货机状态机设计，内有word介绍设计的原理(A simple realization of a vending machine with verilog state machine design, there are design principles introduced word)
- 2021-01-20 23:48:42下载
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SPWM
利用FPGA内核产生SPWM波，并且频率可调(The FPGA kernel is used to generate SPWM waves, and the frequency is adjustable)
- 2020-12-08 20:19:19下载
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SRAM
SRAM读写测试实例，每秒钟进行一次单字节的SRAM
读和写操作，用chipscope查看时序波形。(SRAM read and write test instances, each time a single byte SRAM
Read and write operations, use chipscope to see the timing waveform.)
- 2017-09-06 11:43:06下载
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sample_SPI
这是一个瑞萨R78/G13的SPI演示程序，详细的放置了说明，很有用的源码(This is one of the SPI Renesas R78/G13 demonstration program, placed a detailed description of very useful source)
- 2013-09-03 02:59:19下载
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跨时钟域数据传输--经典结绳法
资源描述
说明： 结绳模块(Pluse2Toggle): 负责延长待采样信号
同步模块(Synchronization)：负责双触发器锁存
解绳模块(Toggle2Pluse)： 负责将长信号转换成脉冲信号
支持信号从快时钟域到慢时钟域，也支持信号从满时钟域到快时钟域，
- 2022-02-27 06:40:32下载
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RapidIO_avalonst
RapidIO：使用Avalon-ST直通接口的实现方法，可以在fpga上实现(rapidio altera)
- 2017-05-31 22:50:11下载
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FPGA_电梯控制器
本代码主要完成了一个以FPGA为平台的模拟电梯控制器。该设计以Xinlinx 公司Spartan3E 250 板为平台，结合了LCD1602外设和rs232串口发送外设，成功的实现了对一个三层楼的电梯实时运行状态的模拟，1602实时显示电梯及门的状态，并通过串口将当前楼层发送给电脑。代码语言为Verilog HDL.本设计使用的算法思想有三：1、将多个输入信号合并为一个信号。2、Moore 状态机的使用3、电梯多个状态的处理以及处理原则 共同学习，共同进步。
- 2022-04-18 23:18:52下载
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clock18div
Clock Divider, divfactor of 18
- 2015-03-24 18:04:49下载
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