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32 bit shifter verilog fpga
应用背景32 位数字移位器，可用于乘法器的实现关键技术32位数字移位器，采用查招标的方式，基于FPGA和Verilog语言
- 2022-07-28 04:32:07下载
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02_基于ZYNQ的SOC入门基础
VIVADO pl端文档 基于zynq 7020(vivado soc pl example text of zynq)
- 2020-06-17 11:40:02下载
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prtsc
Program for simulate a prtsc
- 2015-09-29 21:54:37下载
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S03_基于ZYNQ的DMA与VDMA的应用开发
说明： VIVADO dma以及vdma 使用文档 基于ZYNQ 7020(vivado DMA&VDMA example text of zynq)
- 2020-06-17 11:40:02下载
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endat_c
说明： 用于读取海德汉绝对位置编码器的位置数据。ENDAT2.1接口(Read the data from ENDAT2.1)
- 2021-04-21 18:58:49下载
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用FPGA实现GPS数据解析，Verilog测试通过
用FPGA实现GPS数据解析，基于Verilog实现，并通过串口发送时间信息
- 2022-03-02 02:41:56下载
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数字频率计
说明： 设计一简易数字频率计，其基本要求是：
1)测量频率范围0～999999Hz；
2)最大读数999999HZ,闸门信号的采样时间为1s；.
3)被测信号可以是正弦波、三角波和方波；
4)显示方式为6位十进制数显示；
5）具有超过量程报警功能。
5)输入信号最大幅值可扩展。
6）测量误差小于+-0.1%。
7)完成全部设计后，可使用EWB进行仿真，检测试验设计电路的正确性。(The basic requirements of designing a simple digital frequency meter are:
1) The measuring frequency range is 0-999999 Hz.
2) The maximum reading is 999999HZ, and the sampling time of gate signal is 1 s.
3) The measured signal can be sine wave, triangle wave and square wave.
4) The display mode is 6-bit decimal number display.
5) It has alarm function beyond range.
5) The maximum amplitude of input signal can be expanded.
6) The measurement error is less than +0.1%.
7) After completing all the design, EWB can be used to simulate and test the correctness of the circuit.)
- 2019-06-20 12:47:51下载
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font6x8
Fonts for LCD 162x64 (6x8)
- 2012-09-05 07:06:05下载
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verilogsram
FPGA Verilog HDL 读写SRAM(SRAM FPGA Verilog HDL to read and write)
- 2012-11-11 11:41:04下载
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可以验证组件（VIP）基于System Verilog
可以基于System Verilog验证IP。
- 2022-01-25 17:58:59下载
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