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  1. 编程语言：Verilog
  2. 代码类别：通讯编程
  3. 发布时间：不限
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▍1. Verilog

  基于FPGA的16QAM调制解调设计，以及仿真实现(Design of 16QAM Modulation and Demodulation Based on FPGA)

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2021-02-19发布
通讯编程 Verilog

▍2. Verilog

说明：  基于FPGA的16QAM调制解调设计，以及仿真实现(Design of 16QAM Modulation and Demodulation Based on FPGA)

5
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2021-02-19发布
通讯编程 Verilog

▍3. 8b10b Verilog

  采用verilog语言基于查找表描述8b10b编码源代码(Using Verilog language to describe 8B10B encoding source code based on look-up table)

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2021-01-27发布
通讯编程 Verilog

▍4. 03_hbf_test_128m22

  半带滤波器，工作在采样率122.88Msps上(Half-band filter, working at the sampling rate of 122.88 Msps)

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2020-12-23发布
通讯编程 Verilog

▍5. 03_hbf_test_128m22

说明：  半带滤波器，工作在采样率122.88Msps上(Half-band filter, working at the sampling rate of 122.88 Msps)

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2020-12-23发布
通讯编程 Verilog

▍6. verilog HDL

  DS18B20温度模块，LCD1602显示(DS18B20 Temperature Module, LCD1602 Display)

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2020-09-04发布
通讯编程 Verilog

▍7. verilog HDL

说明：  DS18B20温度模块，LCD1602显示(DS18B20 Temperature Module, LCD1602 Display)

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2020-09-04发布
通讯编程 Verilog

▍8. ram_test

说明：  对片内RAM进行读写操作，通过数据的写入和读出，对RAM的操作进行熟悉。(Read and write ram on chip, and get familiar with RAM operation through data writing and reading.)

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2020-08-17发布
通讯编程 Verilog

▍9. cordic

  实现可连续输入数据做三角函数变换处理，通过verilog代码实现，(It realizes triangular function transformation for continuous input data.)

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2020-06-21发布
通讯编程 Verilog

▍10. cordic

说明：  实现可连续输入数据做三角函数变换处理，通过verilog代码实现，(It realizes triangular function transformation for continuous input data.)

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2020-06-21发布
通讯编程 Verilog

▍11. 伪随机LED灯，实现八位LED灯的随机闪烁以及其它的控制

  伪随机LED灯，实现八位LED灯的随机闪烁以及其它的控制。(Pseudo-random LED lamp)

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2020-06-21发布
通讯编程 Verilog

▍12. 伪随机led

说明：  伪随机LED灯，实现八位LED灯的随机闪烁以及其它的控制。(Pseudo-random LED lamp)

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2020-06-21发布
通讯编程 Verilog

▍13. vhdl1008

  PCI slave IP core, in VHDL language ,has been verified,it is very easy to use. it is an ideal IP to study PCI,design PCI Bridge

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2020-06-18发布
通讯编程 Verilog

▍14. vhdl1008

说明：  PCI slave IP core, in VHDL language ,has been verified,it is very easy to use. it is an ideal IP to study PCI,design PCI Bridge

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2020-06-18发布
通讯编程 Verilog

▍15. 64-bit-array-multiplier

说明：  这个是64bit矩阵乘法实现代码，语言是verilog。(This is the 64 bit matrix multiplication implementation code, and the language is Verilog.)

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2020-06-18发布
通讯编程 Verilog

▍16. sd模型

  完整的Verilog验证模型，包括设备完整的状态。(Complete verilog Verification Model)

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2020-06-16发布
通讯编程 Verilog

▍17. sd模型

说明：  完整的Verilog验证模型，包括设备完整的状态。(Complete verilog Verification Model)

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2020-06-16发布
通讯编程 Verilog

▍18. s29gl256s

说明：  s29gl256s nor flash 源代码(s29gl256s device source code)

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2019-03-03发布
通讯编程 Verilog

▍19. multi_booth

  基于quartus的布斯乘法器的verilog 实现。布斯乘法算法是计算机中一种利用数的2的补码形式来计算乘法的算法。该算法由安德鲁·唐纳德·布斯于1950 年发明，当时他在伦敦大学伯克贝克学院做晶体学研究。布斯曾使用过台式计算器，由于用这种计算器来做移位计算比加法快，他发明了该算法来加快计算速度。(The verilog codes of booth multiplier based on quartus. Booth multiplication algorithm is a computer algorithm using the complement form of number 2 to calculate the multiplication. The algorithm was invented in 1950 by Andrew Donald booth, who was working on crystallography at birkbeck college, university of London. Booth used a desktop calculator, and because it was faster to do shifts than to add, he invented the algorithm to speed up the calculations.)

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2019-01-06发布
通讯编程 Verilog

▍20. multi_booth

说明：  基于quartus的布斯乘法器的verilog 实现。布斯乘法算法是计算机中一种利用数的2的补码形式来计算乘法的算法。该算法由安德鲁·唐纳德·布斯于1950 年发明，当时他在伦敦大学伯克贝克学院做晶体学研究。布斯曾使用过台式计算器，由于用这种计算器来做移位计算比加法快，他发明了该算法来加快计算速度。(The verilog codes of booth multiplier based on quartus. Booth multiplication algorithm is a computer algorithm using the complement form of number 2 to calculate the multiplication. The algorithm was invented in 1950 by Andrew Donald booth, who was working on crystallography at birkbeck college, university of London. Booth used a desktop calculator, and because it was faster to do shifts than to add, he invented the algorithm to speed up the calculations.)

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2019-01-06发布
通讯编程 Verilog

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