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可控制器

于 2022-01-26 发布文件大小:40.06 kB

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代码说明：

应用背景此代码是用于执行器和传感器，可以在网络中实现一个很好的连接与其他节点和主。关键技术VHDL代码；可以控制位CRC校验和填料-掩模的验收规范

下载说明：请别用迅雷下载，失败请重下，重下不扣分！

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8位CPU的VHDL设计代码没有测试
8 bit cpu vhdl design code not tested

2022-03-21 20:07:37下载

积分：1
VHDL项目设置：FLV
vhdl项目设置： flv的 -VHDL Project Settings: flv

2022-07-18 14:46:43下载

积分：1
med01-165
median filter details

2011-01-30 18:29:06下载

积分：1
cpu
cache，实现了部分简单指令，仿真模拟确认可行(Single-cycle CPU, to achieve some simple instruction, simulation confirm feasible)

2015-01-05 14:11:10下载

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"Verilog HDL Design Guide" 8
《Verilog HDL 程序设计教程》8-"Verilog HDL Design Guide" 8

2022-10-10 02:30:02下载

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router_routing
片上网络NOC基于fpga实现的，routing模块。(NOC-chip networks realized fpga-based, routing module.)

2021-03-03 17:19:32下载

积分：1
polynomial_compute
我自己当初用来求解arctan 暂时没有搞成ip形式搞好了还要传git 这个代码还没有搞好，因为急需要下载东西如果感兴趣可以联系我邮件(this is a not full wrappered code very crude use chebyshev to caculate arctan function i m urgent to download a model from pudn so i do this.)

2019-05-31 23:25:00下载

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基于fpga的实时视频采集与显示高速化小型化
基于fpga的实时视频采集与显示高速化小型化-fpga

2022-01-30 23:55:32下载

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super fast debounce button on vhdl, xilinx xc
super fast debounce button on vhdl, xilinx xc

2022-10-30 03:20:04下载

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code
涉及到常用的模块，参数可配置，可以很方便的集成到应用中(Related to commonly used modules, parameters can be configured, can be easily integrated into applications)

2008-06-13 22:30:14下载

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