登录
首页 » VHDL » 本文通过大量的例子讲解VHDL。对于初学者来说是一本非常好的 教材...

本文通过大量的例子讲解VHDL。对于初学者来说是一本非常好的 教材...

于 2022-01-26 发布 文件大小:1.70 MB
0 126
下载积分: 2 下载次数: 1

代码说明:

本文通过大量的例子讲解VHDL。对于初学者来说是一本非常好的 教材-Based on the large number of examples of VHDL. For a newcomer it is a very good teaching

下载说明:请别用迅雷下载,失败请重下,重下不扣分!

发表评论

0 个回复

  • usb_test
    Cypress USB 的主从FPGA 控制实现代码(USB controller)
    2012-10-09 10:39:52下载
    积分:1
  • ecc算法源码
    该源码表述了ecc算法如何用vhdl实现RSA(Ron Rivest,Adi Shamir,Len Adleman三位天才的名字)一样,ECC(Elliptic Curves Cryptography,椭圆曲线密码编码学)也属于公开密钥算
    2022-03-07 00:08:00下载
    积分:1
  • vhdl经典源代码――键盘接口设计,入门者必须掌握
    vhdl经典源代码――键盘接口设计,入门者必须掌握-vhdl classical source code-- the keyboard interface design, beginners must master
    2022-11-20 22:55:03下载
    积分:1
  • 移位乘法器的输入为两个4位操作数a和b,启动乘法器由stb控制,clk信号提供系统定时。乘法器的结果为8位信号result,乘法结束后置信号done为1....
    移位乘法器的输入为两个4位操作数a和b,启动乘法器由stb控制,clk信号提供系统定时。乘法器的结果为8位信号result,乘法结束后置信号done为1. 乘法算法采用原码移位乘法,即对两个操作数进行逐位的移位相加,迭代4次后输出结果。具体算法: 1. 被乘数和乘数的高位补0,扩展成8位。 2. 乘法依次向右移位,并检查其最低位,如果为1,则将被乘数和部分和相加,然后将被乘数向左移位;如果为0,则仅仅将被乘数向左移位。移位时,被乘数的低端和乘数的高端均移入0. 3. 当乘数变成全0后,乘法结束。 -err
    2022-04-10 04:29:26下载
    积分:1
  • uart01
    一种实现计算机接口rs232与FPGA通信的基于VHDL语言设计的一段非常简洁的程序(A RS232 computer interface implementation with FPGA-based VHDL language communications designed a very simple procedure)
    2009-03-15 23:13:42下载
    积分:1
  • SRAM 简单测试
    SRAM简单测试,测试其性能及其速度,判断SRAM是否可用(Test its performance and speed to determine if SRAM is available)
    2020-07-10 09:58:55下载
    积分:1
  • VHDL_programs
    VHDL programmes for basic digital circuits. begineers can learn easily
    2013-09-28 13:46:58下载
    积分:1
  • multiplication
    我感谢我能找到这个页面WAP相同的帮助。我在开始设计的VHDL的电路。
    2023-01-29 02:40:04下载
    积分:1
  • fir
    vhdl code for fir filter
    2011-02-18 11:51:26下载
    积分:1
  • LMS filter
    这是一个用结构化语言编写的25抽头LMS算法建模.VHDL加法器/减法器、乘法器、延迟元件的代码分别编写并用LMS代码实例化。
    2022-02-10 10:42:31下载
    积分:1
  • 696516资源总数
  • 106571会员总数
  • 2今日下载