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cyclone and cyclone2 system used in the use 5v, making FPGA chip compatible with...

于 2022-02-03 发布文件大小:121.11 kB

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代码说明：

cyclone和cyclone2用在5v系统里使用方法,使得FPGA芯片在5V系统中兼容-cyclone and cyclone2 system used in the use 5v, making FPGA chip compatible with the 5V system

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sine_cordic
generate sine wave. Inputs : Amplitude, phasein, frequency

2013-07-22 10:25:41下载

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SineGen
Basic VHDL code to create a sine wave generator for an FPGA board.

2014-01-24 01:04:15下载

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fwwallace
wallace tree multiplier in verrilog

2013-03-19 00:15:07下载

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fpga
fpga的一些经验之谈，对初学者比较有用，都是些容易出错误的地方(FPGA some experiences, more useful for beginners, are more vulnerable to the wrong place)

2007-09-21 20:58:57下载

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这是一个时钟的VHDL源代码，其中包含了源代码，以及工程。
这是一个时钟的VHDL的源程序，里面包含有源程序，还有工程文件对大家很有帮助-This is a clock VHDL source code, which contains the source code, as well as engineering documents helpful to everyone

2023-03-26 14:20:04下载

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DE2_70_TV
de2 70 开发板的演示程序，verilog语言编写，视频输入输出(de2 70 development board demo program, verilog language written, video input and output)

2013-04-09 19:29:51下载

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dpwm_8bit
数字脉冲宽度调制，将输入的数字信号转换为对应占空比的模拟波形(Digital pulse width modulation, the digital signal is converted to the corresponding input of the duty cycle of the analog waveform)

2020-06-28 16:00:02下载

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shuzishizhong
数字时钟，包括流程图以及编码和完整的实验报告，内容详细丰富。(Digital clock, including flowcharts, and coding and a full lab report, detailed and rich.)

2011-12-20 19:53:07下载

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四路抢答器的设计与实现
在本次设计中，设计了一款软件，可以实现四个选手抢答问题的模式。包括有计时模块、计分模块、分频模块、消抖模块以及动态显示模块。模块中，有一部分是通过VHDL编程实现，有一部分是通过直接调用软件库中的逻辑器件进行组合，进而设计成一个大模块；最后，把这些所有的模块都进行正确的组合，得到正确的仿真结果，下载到FPGA开发板上，同样可以正确的实现（显示第一个抢答选手的号数以及当前各个选手的积分情况）

2022-02-01 15:33:40下载

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半加器
半加器

2022-10-16 16:40:03下载

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