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FPGA 的数字闹钟

于 2022-03-10 发布 文件大小:1,022.70 kB
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代码说明:

这个项目旨在在 FPGA 上实现数字闹钟的功能。尽快 FPGA 打开时,时钟就开始了。可以使用 FPGA 板上提供 dip 开关设置报警。通过相应的 dip 开关指示灯表明了这一点。计数器保持工作,一旦报警消除,像声音放大通过扬声器蜂鸣器。 该项目是充分的。享受它吧 !

下载说明:请别用迅雷下载,失败请重下,重下不扣分!

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  • 匹配滤波器的verilog实现
    运用quatusii工具基于verilog实现匹配滤波器
    2022-11-22 14:15:03下载
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  • traffic_lights
     交通灯控制器控制红(r)、绿(g)、黄(y)三种不同颜色的交通灯,这三种不同颜色灯的亮、灭分别由三个定时器(timer1、timer2、timer3)控制;  当某个定时器工作时,它所控制的交通灯亮,直到设定的定时时间到(该定时器状态由’0’变’1’),交通灯跳转到另一种状态;  clk是脉冲控制端(图中未标出);reset是异步复位端,复位状态为红色交通灯亮;  输出端r、g、y分别表示三种颜色交通灯的亮、灭状态。 ( traffic light controller control red (R), green (g), yellow (y) three different colors of traffic lights, three different colors of bright lights, off by three timer (Timer1, Timer2, Timer3 ) control  When a timer work, it controls the traffic lights, until the set timing (the timer status ' 0 ' for ' 1' ), traffic lights Jump to another state  clk is the pulse control terminal (not shown) reset is asynchronous reset terminal, the reset state for the red traffic lights  output terminal r, g, y represent the three colors of traffic lights bright, the off state.)
    2020-12-19 15:09:10下载
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  • lmf
    在ISE下,FPGA产生线性调频信号,并且产生信号的参数可调(In ISE, the FPGA generates a linear frequency modulation signal, and the parameters of the signal are adjustable.)
    2018-03-29 15:31:15下载
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  • 基于Verilog的自动售卖机
    基于Verilog的自动售卖机设计,利用数码管显示商品价格和找零,用LED灯的量灭表示选定的商品,用按键(按键设置了消抖模块)控制确认购买和选择和找零,购买并找零后重新跳回IDLE重新选择商品。
    2022-09-01 01:55:03下载
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  • vhdl
    vhdl状态机设计,文件简单详细易懂,可以使用在交通灯,文件配置等系统上。(vhdl state machine design, simple, detailed and easy to understand, you can use the traffic light system file configuration file.)
    2012-09-04 15:21:53下载
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  • RAM
    这是个双端口双端口ram的定义,当然读者在此基础上还可以扩充(This is a dual-port dual-port ram definition, of course, on the basis of the readers can also be expanded)
    2009-05-24 11:41:19下载
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  • FPGA密码锁状态机的设计
    使用的是Verilog HDL编写的状态机的设计。完成的密码锁的解锁,上锁功能,密码锁的修改密码功能,使用的飓风的开发板完成的实验。使用数码管显示密码,用led灯及蜂鸣器提示密码的正确与否,代码比较简单,使用Modlisme仿真的波形比较清楚。代码的注释很多。很适合入门者学习。
    2022-04-27 06:41:16下载
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  • AD5764 verilog hdl 代码,它工作得好
    把它写在 verilog hdl 代码中,在我的板测试,效果很好,你可以将它直接复制到您的项目,然后使用它没有任何问题
    2022-07-07 07:08:04下载
    积分:1
  • Block-cipher-lock
    密码锁verilog源代码,包括四个七段数码管显示模块,设置密码以及输入密码校验模块(Password lock Verilog source code, including four of seven digital tube display module, set the password and password verification module)
    2014-01-11 23:57:19下载
    积分:1
  • cam2
    DE2-115 + D5M Camera to VGA PC
    2020-07-09 19:48:55下载
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