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设计采用Verilog HDL 16位CPU。

于 2022-03-11 发布 文件大小:1.21 kB
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代码说明:

design cpu 16 bits by verilog HDL.

下载说明:请别用迅雷下载,失败请重下,重下不扣分!

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  • vote7
    说明:  自己设计的一个其人投票系统,对于VHDL初学者可以参考下(One of their own design their human voting system, for VHDL beginners can refer to the following)
    2009-08-30 09:25:04下载
    积分:1
  • QMD
    说明:  实现了QPSK的调制,使用了ise自带的dds的IP核(QPSK is modulated and the IP core of DDS is used in ise.)
    2019-05-05 15:37:58下载
    积分:1
  • verilog_curr_design
    说明:  实现中采用 Verilog HDL 描述、 ModelSim 进行功能仿真、 Quartus II 进行逻辑综合和适配下载(Design of table tennis game machine)
    2020-07-16 21:49:36下载
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  • CJQ-V1.0-fpga
    实现FPGA对AD芯片AD7060的控制,程序代码的注释很多,易学易懂,适合初学者学习使用(it is good ...)
    2013-10-10 11:20:31下载
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  • 可实现找钱功能的自动售邮票机,可买两种邮票,一元的和五角的...
    可实现找钱功能的自动售邮票机,可买两种邮票,一元的和五角的-Money function can be realized stamp vending machine, to buy two stamps, one dollar and the Pentagon
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    verilog实现的“六进制约翰逊计数器”。-verilog implementation of the " six hexadecimal Johnson counters."
    2022-05-10 11:02:11下载
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  • FPGA60进制数码管显示VHDL代码
    FPGA设计中的60进制计数器,通过2个七段数码管系那是出来。代码简单易懂,仿真通过,而且在FPGA开发板上加载显示成功。很有用的入门代码。
    2022-07-12 13:55:48下载
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    主要讲述了数码相机MIPI接口协议说明,工作模式及信号传输原理等(Camera Interface Overview)
    2014-01-20 22:19:32下载
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  • MS5611控制 温度 压力 fpga vhdl
    利用vhdl 语言实现对ms5611的控制,读取温度值和压力值
    2023-04-17 17:10:03下载
    积分:1
  • 计数器,vhdl,调试通过。
    COUNTER 用于xilinx硬件,里面已建工程,修改ucf即可。设计由3部分组成,计数器,100M分配时钟,顶层模块,其中顶层模块包括计数器和分频器。
    2022-01-22 06:17:06下载
    积分:1
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