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altera several new FPGA configuration methods and the use of experience
altera的几种新型的FPGA的配置方法和使用心得-altera several new FPGA configuration methods and the use of experience
- 2022-05-09 07:27:04下载
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verilog黄金参考指南中文版
Verilog 黄金参考指南是 Verilog 硬件描述语言及其语法 语义 合并以及将它应用到硬件设计的一个简明的快速参考指南。(Verilog Golden Reference Guide is a concise and fast reference guide for Verilog Hardware Description Language and its syntax and semantics merging and its application to hardware design.)
- 2020-06-18 04:20:02下载
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vhdl 键盘程序，对键盘输入的字符进行判断，写入fpga中
vhdl 键盘程序，对键盘输入的字符进行判断，写入fpga中-VHDL key
- 2022-03-03 15:13:57下载
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用键盘控制FPGA，再由FPGA控制VGA显示器是好东西
用键盘控制FPGA，再由FPGA控制VGA显示器是好东西-Use the keyboard to control FPGA, and then by the FPGA to control VGA display is a good thing
- 2022-04-11 22:37:54下载
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Electronicorgan
利用VHDL编写的电子琴发生器，以简单的演奏电路论文(Electronic organ prepared using VHDL generator to perform a simple circuit Papers)
- 2009-03-06 08:52:10下载
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基数 4 蝴蝶算法的实现
给定的序列
x(n) 被摧毁成 4 序列的长度 N/4 每个。而不是划分
用密度泛函理论计算成两半在 RAD2，种四分。N 点
输入的序列被分成四个的子序列，x(4n)，x(4n+1)，，x(4n+2)，和
x （4n + 3），其中 n = 0，1，...N/4-1.Radix-4 使用日志4N
阶段，每个阶段有 N/4 蝴蝶。N/4 蝴蝶涉及每年
阶段和阶段数目是日志4N N 点序列。因此，
复杂的乘法次数是 3N/4 日志4N 和数目
复杂的加法是 12N/4 日志4n。在基数 2 FFT 的比较
复杂的乘法次数是减少 25%
- 2023-08-02 05:25:03下载
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一种使用modelsim6简单的编码程序
A program for a simple encoder using ModelSim6
- 2022-02-04 18:51:34下载
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使用VHDL语言，对Altera公司的DE2开发板进行开发，本例实现了对板上7段数码管的显示，在niosiiIDE上基于硬件实现小灯的循环亮灭...
使用VHDL语言，对Altera公司的DE2开发板进行开发，本例实现了对板上7段数码管的显示，在niosiiIDE上基于硬件实现小灯的循环亮灭-Using VHDL language, on Altera s DE2 development board for development, which in this case the realization of paragraph 7 of the on-board digital tube display, in niosiiIDE hardware implementation based on a small circle of bright lights out
- 2022-03-17 06:00:39下载
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tanchishe-QuartusII
VGA显示FPGA实现的VHDL语言的贪吃蛇游戏设计
本设计分为6个模块主要是扫描模块 VGA现实和控制模块 游戏设计的模块 电源模块等
用QUARTUS2仿真运行(VGA display FPGA VHDL language to realize the Snake game design
The design is divided into six modules mainly scanning module VGA module power module and control module reality game design, etc.
Simulation run with QUARTUS2)
- 2020-11-06 10:09:50下载
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Verilog HDL编写的总线功能模型，十分有用，需要的下载
Verilog HDL编写的总线功能模型，十分有用，需要的下载-Verilog HDL prepared by the bus functional model is useful, it needs to download
- 2022-03-20 19:48:39下载
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