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FPGA、Verilog浮点计算加减乘除

于 2022-05-08 发布 文件大小:1.96 kB
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代码说明:

FPGA、Verilog浮点计算加减乘除四则运算

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  • classics_verilog_codes_for_commom_projects
    它包含大量用于常见项目的经典verilog代码,如FIFO、add8、RS编码、多路复用等。
    2022-03-02 04:53:32下载
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  • 一位十进制可逆计数器的Verilog代码
    Verilog实现的一位十进制可逆计数器,可以实现十进制数的加减功能,有仿真图,计数器模数为10,有计数器使能控制,进位输出,具有同步置数和异步清零功能
    2022-03-15 17:20:35下载
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  • T200071012217h
    此源码为线性相位滤波的vhdl源码与设计心的体会,理论分分析与工程实践总结相结合,有非常大的参考价值 可直接使用。 (The source for the linear phase filter VHDL source code and design of the heart experience, theoretical analysis to summarize the combination of engineering practice, a very large reference value can be used directly.)
    2012-07-10 16:08:08下载
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  • iir
    八阶巴特沃兹iir数字滤波器,四个二阶节,verilog代码实现,多路分时复用(batterworth,iir,8order,four second order section)
    2016-01-27 19:49:47下载
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  • 基于FPGA的16QAM的设计
    设计了基于FPGA的16QAM的设计方法。包括调制和解调。
    2022-07-28 00:38:15下载
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  • shuzihongdianlu
    数字钟电路的实现,可以24小时计时,可调整时间!(Digital clock circuit implementation, a 24-hour timer, adjustable time!)
    2013-08-18 14:49:14下载
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  • gtx_interface_ip
    高速串行设计FPGA-GTX IP设置生成,可动态配置速率2.4Gbps,1.2Gbps,0.6Gbps,自适应链接(High-speed serial design FPGA-GTX IP settings generated dynamically configurable rate of 2.4Gbps, 1.2Gbps, 0.6Gbps, adaptive link)
    2016-09-22 09:48:00下载
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  • elc_clock
    verilog实践 elc_clock 电子时钟设计(Verilog design practice elc_clock electronic clock)
    2008-12-10 16:06:48下载
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  • FPGA 分频器
    我以altera公司的 FPGA,型号是DE2 系列 软件的版本是quartusii  9.0  程序实现了2,4,6,8,分频,
    2022-02-27 05:04:46下载
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  • Blazing-Fiber-grating
    闪耀光栅 有带阻滤波器作用的闪耀光纤光栅,反射角度可以控制(Blazed grating)
    2021-03-27 09:19:12下载
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