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verilog时钟分频器~ 50hmz波特率9600bps,使用~

于 2022-06-03 发布 文件大小:8.98 kB
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代码说明:

verilog分频器~时钟为50hmz,波特率采用9600bps~-Verilog clock divider ~ 50hmz, using baud rate 9600bps ~

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  • AD7982_IF
    AD转换代码,主要练习,没有具体的功能可以实现的,因为只是一部分(AD conversion code, practice, no specific function can be realized, because only part)
    2014-06-14 09:01:03下载
    积分:1
  • asynchronous reset state machine
    异步复位状态机 -- State Machine with Asynchronous Reset -- dowload from: www.fpga.com.cn & www.pld.com.cn -asynchronous reset state machine-- State Machine with Asynchronou "s Reset-- dowload from : www.fpga.com.cn
    2023-07-14 12:30:03下载
    积分:1
  • 55593402DDS_vhdl
    DDS分频实现,全部代码的完整过程,包括截图等(DDS divider to achieve the complete process of all the code)
    2013-05-15 16:49:55下载
    积分:1
  • 1
    说明:  一个解决除法溢出的例子,可以学习到很多,注释很详细(A solution to the division overflow example, you can learn a lot, very detailed notes)
    2013-12-24 09:19:13下载
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  • cycle_measure
    测量周期,此程序已经在EP2C板子上成功实现(mesure cycle)
    2013-08-29 16:09:17下载
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    stbc空时编码源码,非常好的程序。verilog程序-STBC Space-Time Coding Source, very good program. Verilog program
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