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turbo_encode
turbo码的编码程序,verilog HDL,在ISE环境中(turbo code encoding process)
- 2014-03-29 15:09:58下载
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用于实现sin，cos三角函数计数的VHDL程序代码
用于实现sin，cos三角函数计数的VHDL程序代码-towards sin, cos trigonometry count VHDL code
- 2022-01-25 23:34:00下载
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ap01
一個紅外線感測電路的設計，是經由opa來設計。(An infrared sensing circuit design, is designed by opa.)
- 2011-10-19 14:22:24下载
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通用串行异步收发器8251的Verilog HDL源代码,经过仿真验证。
通用串行异步收发器8251的Verilog HDL源代码,经过仿真验证。
-Universal Serial Asynchronous Receiver Transmitter 8251 the Verilog HDL source code, through simulation.
- 2022-05-22 23:15:29下载
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这是我自己编写的三分频，也就是奇数分频，占空比为1：1，当然如果需要其它奇数分频，只要将程序里面的N和counter修改即可...
这是我自己编写的三分频，也就是奇数分频，占空比为1：1，当然如果需要其它奇数分频，只要将程序里面的N和counter修改即可-This was my third prepared by the frequency, which is odd hours, frequency and duty ratio of 1:1. Of course, if the needs of other odd hours, frequency, as long as the proceedings inside the N and counter can be amended
- 2022-10-27 10:05:04下载
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unit5
低频数字式相位测量仪
使用的VHDL语言，在MUXPLUS2环境下使用！
(digit hpase detecter use for low-frequence)
- 2010-05-07 17:00:35下载
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RAM存储器： 设定16 个8 位存储单元。如果read= 1 则dataout<=mem(conv_integer(address)). 如果write
RAM存储器： 设定16 个8 位存储单元。如果read= 1 则dataout
- 2022-08-05 20:01:41下载
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SineGen
Basic VHDL code to create a sine wave generator for an FPGA board.
- 2014-01-24 01:04:15下载
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VGA
本科毕业设计，简易逻辑分析仪，重点在于用CPLD搭建显卡，输出VGA信号驱动显示器显示逻辑波形(A design for LA,use cpld to generate VGA signals.)
- 2014-04-28 11:22:01下载
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testbench
说明： altera 最新的CYCLONE IV的pci-e核的testbench，VHDL源程序。(altera latest CYCLONE IV of the pci-e core testbench, VHDL source code.)
- 2010-04-22 10:20:24下载
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