登录
首页 » VHDL » 课程设计要求设计并用FPGA实现一个数字频率计,具体设计要求如下: 测量频率范围: 10Hz~100KHz 精度: ΔF / F ≤ ±2 % 系统外部...

课程设计要求设计并用FPGA实现一个数字频率计,具体设计要求如下: 测量频率范围: 10Hz~100KHz 精度: ΔF / F ≤ ±2 % 系统外部...

于 2022-07-04 发布 文件大小:141.51 kB
0 96
下载积分: 2 下载次数: 2

代码说明:

课程设计要求设计并用FPGA实现一个数字频率计,具体设计要求如下: 测量频率范围: 10Hz~100KHz 精度: ΔF / F ≤ ±2 % 系统外部时钟: 1024Hz 测量波形: 方波 Vp-p = 3~5 V 硬件设备:Altera Flex10K10 五位数码管 LED发光二极管 编程语言:Verilog HDL / VHDL-curriculum design and FPGA design to achieve a digital frequency meter, the specific design requirements are as follows : measurement frequency range : 10Hz to 100KHz precision : F/F 2% external clock system : 1024Hz Waveform Measurement : square Vp-p = 3 ~ 5 V hardware : Altera Flex10K10 five digital LED light emitting diode programming languages : Verilog HDL/VHDL

下载说明:请别用迅雷下载,失败请重下,重下不扣分!

发表评论

0 个回复

  • 一款verilog设计的SRAM控制器svtb_ahb_sram
    一款verilog设计的SRAM控制器,可以实现AHB总线控制的功能。(abcdefghijklmnopqrstuvwxyz)
    2020-06-30 13:40:02下载
    积分:1
  • en.SPI_EEPROM_Verilog_models_V10
    spi接口的eeprom模型,型号为st公司m65pxx(The eeprom model of spi interface is st company m65pxx)
    2021-01-19 14:28:44下载
    积分:1
  • zzlB
    QUARTUSII 9.0 下的三级流水线中值滤波工程,vhdl源程序等。可用于fpga做图像预处理。(the three stage pipeline median filter project under QUARTUSII 9 , VHDL source program. which can be used by FPGA to do image preprocessing. )
    2011-12-21 16:17:41下载
    积分:1
  • DA
    DOCUMENT ON DISTRIBUTED ARITHMATIC
    2014-02-05 17:06:51下载
    积分:1
  • 这是用VHDL实现的8位加法器,对新手有点帮助。
    这是用VHDL实现的8位加法器,对新手有点帮助。-This is achieved using VHDL adder 8, a little help to novices.
    2022-07-20 21:54:41下载
    积分:1
  • percent
    verilog编写的计算百分比模块(Verilog prepared by calculating the percentage module)
    2005-03-08 21:33:38下载
    积分:1
  • U_XMIT
    8位并行转穿行发送程序,波特率可自行设置,经检验有实用效果(8-bit parallel transfer walk through the sending program, the baud rate can be set up their own practical effect inspection)
    2013-03-15 19:05:49下载
    积分:1
  • Verilog based on the eight
    基于Verilog的八层电梯设计,能够实现自动化的电梯控制。-Verilog based on the eight-lift designed to automate the elevator control.
    2022-08-13 02:17:13下载
    积分:1
  • xiawenyu-verilog-
    数字系统设计的入门书,教你如何学会用verilog语言实现各种数字逻辑功能,例程经典易懂(xiawenyu verilog)
    2012-02-18 11:40:39下载
    积分:1
  • vhdl 计数器源程序,大家看看吧 vhdl 计数器源程序,大家看看吧...
    vhdl 计数器源程序,大家看看吧 vhdl 计数器源程序,大家看看吧-vhdl counter source, we see it vhdl counter source, we see it
    2022-08-21 00:34:32下载
    积分:1
  • 696516资源总数
  • 106571会员总数
  • 2今日下载