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TLC2543
使用Verilog实现的AD采样，很有用的！(Implemented using Verilog AD sampling, very useful!)
- 2020-11-18 15:59:39下载
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变采样滤波器的FPGA实现（25M<-->30.72M变采样）
已经应用到USRP N210中，实现的部分是25M-->30.72M的变采样，以适应LTE协议对物理层的要求，代码已经仿真验证，并且在USRP的板子中实现（XIlinx）
- 2022-08-20 05:07:27下载
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dcfifo_design_example
ALTERA发布的内部FIFO读写示例，很有参考价值，对初学者会有一定的帮助(ALTERA' s internal FIFO read and write examples of great reference value, there will be some help for beginners)
- 2010-11-13 23:31:11下载
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交通灯 verilog
有限状态机的交通灯控制，整个项目为工作从 xilinx，ISE 设计套件中添加和配置用于在斯巴达 3，从 digilent 的 nexys 2，具有每个归档文件和项目文件，适合两路交通灯号，交通和行人的要求的传感器。
- 2022-03-21 16:28:42下载
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s
说明： 反应力测试 利用图片的变换根据用户点击的反应时间判断(Reaction force measurement using the picture of the transformation reaction time based on user clicks judgment)
- 2013-06-02 20:59:41下载
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source_file
说明： 有限状态机 rtl code 和 TB验证环境(Finite state machine RTL code and TB verification environment)
- 2020-08-13 15:05:19下载
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quartusandmodelsim
本文档对quartus与modelsim运用操作描述十分详细，对初学者，会有很大帮助！(Quartus and modelsim this document on the use of operations described in great detail, for beginners, there will be a great help!)
- 2010-08-30 23:51:02下载
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Study_Test
实现简单的硬件加法器、除法器，实现源码文中注释(Realize simple hardware adder and divider, realize source code)
- 2020-06-21 05:20:01下载
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一个8位处理器结构，源码分析
说明： 关于一个8位处理器的分析，和源代码，VHDL语言设计，经过测试(on an eight processors, and source code, VHDL design, the test)
- 2005-12-27 21:39:45下载
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emifa_ram
FPGA与DSP的EMIF通信，EMIF的RAM这方面相应的程序(FPGA and DSP EMIF communication)
- 2020-12-01 15:49:26下载
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