-
modelsim输出文件代码演示 verilog
资源描述
modelsim输出文件代码演示 verilog 内含头文件和testbench.Verilog HDL是一种硬件描述语言（HDL:Hardware Description Language），以文本形式来描述数字系统硬件的结构和行为的语言，用它可以表示逻辑电路图、逻辑表达式。
- 2022-03-04 02:46:20下载
- 积分：1
-
小绿人请加油
这里是由控制程序从ROM模块读取图片信息，然后写入VGA接口。里面包括6副16*16的图片信息，在屏幕上出现小绿人的动画
- 2022-03-03 12:54:29下载
- 积分：1
-
Xilinx 7系列FPGA资料
说明： 对fpga的学习有一点帮助，属于较为基础的部分(It has a little help to the study of FPGA, which belongs to the more basic part)
- 2021-04-07 12:03:10下载
- 积分：1
-
I2C slave设计代码
I2C slave功能模块的一种实现方式，简单易根据自己实际需求做修改，已经过FPGA验证可以很好的工作
- 2022-03-20 06:59:34下载
- 积分：1
-
zhentongbu
ＦＰＧＡ在通信上的运用：基于VHDL的帧同步程序(Application of FPGA in communication: Based on VHDL frame synchronization procedures
)
- 2012-11-28 09:10:05下载
- 积分：1
-
traffic-light
Traffic light program in c presents what happens in our daily life at traffic light signals.
- 2012-11-06 06:50:15下载
- 积分：1
-
DE2_70_D5M_LTM
DE2_70_D5M_LTM主要是在DE2—70开发平台上的一个视频采集和LTM显示的历程，该平台可以作为图像处理和图像算法的硬件系统，还可以对系统进行改进和扩展，作为视频监控系统等
- 2022-07-20 18:35:50下载
- 积分：1
-
source
ＦＰＧＡ与ＳＤＲＡＭ 的 ＶＨＤＬ 接口设计(ｔｈｅ interface of FPGA and SDRAM)
- 2012-03-28 22:17:19下载
- 积分：1
-
PWM 计数器
PWM计数器产生各种占空比，采用IPCORE。THE SAME实现IN SPARTAN3E，SPARTAN3和获得的结果。和FSM也编码生成一个序列的101101。
- 2022-12-31 11:10:08下载
- 积分：1
-
频率计
说明： 1、能正确显示输入信号频率；
2、测量频率范围为1Hz ~ 999999Hz；
3、测量结果以十进制数字显示；
4、能测量幅值较小的信号频率；
5、有自动刷新输出数据的功能（如5s刷新一次）；
6、有自检模块（如产生100Hz的校准方波）；(1. It can correctly display the input signal frequency;
2. The frequency range of measurement is 1Hz ~ 99999hz;
3. The measurement results are displayed in decimal;
4. It can measure signal frequency with small amplitude;
5. It has the function of automatically refreshing the output data (e.g. once in 5S);
6. Self checking module (such as generating 100Hz calibration square wave);)
- 2020-03-28 16:37:56下载
- 积分：1
