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FSK
说明： FSK VHDL FSK调制与解调VHDL程序及仿真(FSK VHDL )
- 2020-09-03 11:28:07下载
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or1200.tar
OpenRISC 1200 cpu with integrated patches to support ORPSOC and FuseSOC builders
- 2014-12-20 04:40:23下载
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Four-FPGA-design-techniques
FPGA设计的四种常用思想与技巧，包括乒乓操作、串并转换、流水线操作、数据接口同步化(FPGA design of the four common ideas and techniques, including the operation of ping-pong, SERDES, pipelining, synchronization of data interface)
- 2012-04-22 22:39:57下载
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一个精确的到0.01s的时钟源程序，对于初学VHDL理解很有帮助，只给了源程序没有给出仿真波形...
一个精确的到0.01s的时钟源程序，对于初学VHDL理解很有帮助，只给了源程序没有给出仿真波形-An accurate clock source to the 0.01s for the beginner to understand VHDL helpful not only to the simulation waveform of the source
- 2022-02-19 22:00:27下载
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Encryption
reversible Data Hiding in Encrypted Images by Reserving Room Before Encryption
- 2016-04-11 17:59:27下载
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Continuous_acoustic_emission_board
说明： 多通道连续声发射数据采集，每个通道最大5M，采用verilog编程，内部用状态机。(Multichannel continuous acoustic emission data acquisition, each channel up to 5M, using Verilog programming, internal state machine.)
- 2020-06-25 13:00:01下载
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用VHDL硬件描述语言实现的对FPGA（Cyclone II）的配置的VHDL源代码。...
用VHDL硬件描述语言实现的对FPGA（Cyclone II）的配置的VHDL源代码。-VHDL hardware description language for FPGA (Cyclone II) configurations VHDL source code.
- 2022-07-11 15:27:50下载
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Auto Gain Control详细代码 AGC-simulink
這裡提供Auto Gain Control
的詳細代碼與功能介紹(Here are details of the code and the Auto Gain Control Functions)
- 2014-01-21 14:14:57下载
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vhdl描述的显示代码 maxplus2开发环境
vhdl描述的显示代码 maxplus2开发环境-VHDL description of the display code development environment maxplus2
- 2022-07-25 04:14:57下载
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CPU_Verilog
此代码完成了流水线CPU的设计。其中有ALU，控制模块，UART等verilog代码。(This code completes the design of pipelined CPU)
- 2017-07-06 19:45:33下载
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