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rscode
R S编 解 码 实 现 代 码
verilog语言(RS CODE AND ENCODE)
- 2013-05-19 16:19:55下载
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4-code
设计一个十进制计数器，具有显示位置随计数时钟在八个数码管中左右滚动的功能。(Design of a decimal counter, a display position with the count clock in at around eight digital scrolling function.)
- 2016-05-24 17:00:31下载
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pj2-NO.6
基于FPGA的电子密码锁设计-已在开发板上成功运行，通过老师检验。(FPGA based electronic password lock design- has been successfully developed on the development board, through the teacher inspection.)
- 2017-05-26 11:54:44下载
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VHDL_Snake_Game
在FPGA开发板上用VHDL语言实现了贪吃蛇游戏，开发软件为quartus 2.这是详细的实验报告，包括源码(Snake game with VHDL FPGA development board, software development quartus 2 This is a detailed experimental report, including the source)
- 2012-06-25 16:15:26下载
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CORDIC，求正弦和余弦算法
cordic求正弦和余弦函数，包含三个文件，一个顶层，一个cordic迭代模块，一个频率字输入模块，最后呈现的波形就是正弦和余弦的样式。
cordic算法采用流水线结构，共迭代7次，简单实现了下，仅供参考，未做时序约束。
- 2022-04-02 09:30:34下载
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da_fir
基于FPGA分布式算法FIR滤波器verilog代码
（本人 小论文 代码，通过验证）
本文提出一种新的FIR滤波器FPGA实现方法。讨论了分布式算法原理，并提出了基于分布式算法FIR滤波器的实现方法。通过改进型分布式算法结构减少硬件资源消耗，用流水线技术提高运算速度，采用分割查找表方法减小存储规模，并在Matlab和Modelsim仿真平台得到验证。
为了节省FPGA逻辑资源、提高系统速度，设计中引入了分布式算法实现有限脉冲响应滤波器(Finite Impulse Response, FIR)。由于FIR滤波器在实现上主要是完成乘累加MAC的功能，采用传统MAC算法设计FIR滤波器将消耗大量硬件资源。而采用分布式算法 (Distributed Arithmetic, DA)，将MAC运算转化为查找表(Look-Up-Table, LUT)输出，不仅能在硬件规模上得到改善，而且更易通过实现流水线设计来提高速度。因此本文采用分布式算法设计一个可配置的FIR滤波器，并以31阶的低通FIR滤波器为例说明分布式算法滤波器结构。( FPGA verilog )
- 2020-11-10 13:49:45下载
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FFT_Module
接收机数字部分FFT模块的代码
包括verilog代码、
matlab仿真、
word文档
testbench
实现FFT(The code of the digital part FFT module of the receiver
Including Verilog, matlab simulation, testbench
Implementation of FFT)
- 2020-11-18 20:49:38下载
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FPGA驱动LCD1602代码
这个是我自己写的LCD1602的代码，经过测试可以再LCD1602上正常运行，由于自己的板子是4线制的，所以通过4线制来通信，对于知道8线数据位编程的同学，不妨试试4线数据位怎么编写
- 2022-03-02 16:10:30下载
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read-string-from-FLASH
read data of type character from flash memory
- 2013-09-08 03:49:15下载
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chuankou
一个用 verilog 实现的对FPGA串口进行控制的，串口控制器源代码(A serial port of FPGA is controlled by verilog. The source code of serial port controller)
- 2018-12-25 17:00:10下载
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