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SPI_Code(Verilog)
SPI总线硬件描述语言Verilog下的实现，含主模式和从模式的实现，经过仿真验证，可作为一个单独的模块使用(SPI bus under the Verilog hardware description language to achieve with the main mode and slave mode realization, through simulation, can be used as a separate module uses)
- 2021-05-13 13:30:02下载
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fifo
fifo是一种先进先出的缓存器，广泛运用在跨时钟域设计，数据缓存中，根据读写可以同步，也可以异步，是一种非常好用的缓存器。
- 2023-08-14 04:10:03下载
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ASK编码（Verilog通过，内含Testbentch）
`timescale 1ns / 1ps
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//creat for the zedboard .
//The AD used ADV7511.
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module ad(
datain , clk , rst , dataout );
input [11:0] datain;
input clk;
input rst;
output [11:0] dataout;
- 2022-01-25 20:47:44下载
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TS 传输流的同步检测模块，该模块可以完成对输入的ts流的同步头检测和跟踪功能
TS 传输流的同步检测模块，该模块可以完成对输入的ts流的同步头检测和跟踪功能，使用该模块，需要注意的是，工作的时钟频率应该搞于ts流的输入时钟 2 倍以上，这样完成对ts流的低码流到系统时钟频率的转换和同步功能
- 2023-03-20 10:45:04下载
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8B_10BENCODER
基于8B10B的编解码模块的设计，使用verilog HDL语言，具有实用价值。(8B10B encoder)
- 2014-05-23 16:39:25下载
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cic_dec_8_five
CIC抽取滤波器，抽取系数8,verilog版本，用于数字下变频(CIC decimation filter, extraction coefficient of 8, verilog version, for digital down-conversion)
- 2010-03-02 12:53:31下载
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SD_rtl
用verilog实现sd卡读写，亲测可用(Implementation of SD card read and write with Verilog)
- 2020-12-27 21:49:02下载
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i2s_input
基于FPGA的i2s接口输入模块设计，其中有原理图和verilog源码，可在Quartus环境下进行仿真(FPGA-based i2s interface input module design, including schematics and verilog source code, can be simulated in Quartus environment)
- 2020-12-14 16:49:14下载
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AD_sample
AD采集模块,设计模块采集AD5270的输出数据(AD Collection module
Design module to collect the output data of AD5270
)
- 2020-11-18 16:19:39下载
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fpga串口的接收程序
fpga串口的接收程序基于verilog语言拿走不用谢。(The receiving program of FPGA serial port is based on Verilog language.)
- 2020-06-18 03:20:02下载
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