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Tcd1500c 时序代码
该代码主要是针对TCD1500c 的时序图，用verilog 语言实现的TCD1500c的时序图，利用modelsim 进行仿真，并且通过测试。
- 2022-09-12 11:05:02下载
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vhdl,十进制加减计数器，输出计数序列信号
vhdl,十进制加减计数器，输出计数序列信号-vhdl, decimal addition and subtraction counter, the output count sequence signal
- 2022-02-07 17:03:29下载
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语音采集,直接在QUARTUSII中打开调试.
语音采集,直接在QUARTUSII中打开调试.-err
- 2022-01-22 11:44:02下载
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一个简单的曼彻斯特编码器，将串行数据转换为曼彻斯特编码数据。
A simple Manchester Encoder to convert serial data to Manchester encoded data.
- 2022-06-20 14:27:09下载
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pi_n
piiii jeirafjorjg knfojojr lajfpopazf
- 2012-05-20 20:42:09下载
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MVB通信架构和流程图
MVB架构流程图。MVB开发用，大连海天资料(MVB development, Dalian Haitian data)
- 2018-09-17 21:39:23下载
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relay_test
Simple relay trigger
- 2015-01-28 12:16:35下载
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眼电图形刺激器设计
完成黑白全屏半屏棋盘格、红绿全屏半屏竖条栅、蓝绿全屏半屏横条栅六种图形格式之间的循环转换，用FPGA实现VGA显示。 设计方案的顶层文件需有几个模块构成：锁相环模块，分频定时模块，时序控制模块和显示模块。每个模块首先用VHDL语言 完成实现并仿真，再生成模块放在顶层的block文件中。锁相环模块作用是把硬件实验板的50MHz转换为适用于VGA800*600 的40MHz时钟；定时模块定时5秒，每5秒转换一种图形显示方式；时序控制模块用于扫描及消隐，使能够正常显示；显示模块 用于显示。各模块正确连线、定义引脚和仿真后，可以下载到FPGA中，连接显示器来显示，六种图形方案每5秒转换，循环。
- 2022-01-22 08:35:40下载
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Micron_SDRAM_DDR2Simulation_model_Verilog
DDR2 SDRAM仿真模型，适合于ModelSim下工作，请先阅读readme(DDR2 SDRAM Simulation Model which is suitable for modelsim. Please read readme file firstly.)
- 2020-10-29 17:49:57下载
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利用AT89C51实现LCD日历电子钟源码
利用AT89C51实现LCD日历电子钟源码-AT89C51 realization of the use of electronic LCD calendar clock source
- 2023-01-24 10:00:03下载
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