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my_SMG_Fengzhuang
FPGA 数码管接口例化编程，学习初级入门verilog编程技术(FPGA 数码管接口例化编程)
- 2015-01-05 20:43:50下载
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fpga 按键控制数码管
按键控制数码管 八位数码管 控制0到9 共阴极数码管
- 2022-09-22 11:25:03下载
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formal_verification
现在最流行的RTL设计方法之一，本书为全球流行的设计入门书籍(One of the most popular RTL design methods nowadays, this book is an introductory book for popular design all over the world.)
- 2020-06-23 22:00:02下载
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以太网控制器Verilog源码(含有MAC,MII接口)
以太网控制器Verilog源码(含有MAC,MII接口)(Ethernet controller Verilog source code (including MAC, MII interface))
- 2017-08-18 10:32:27下载
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基于FPGA的数字时钟设计
基于FPGA的数字时钟设计，通过lcd1602显示时钟，时钟可调节，主要针对学习用FPGA来驱动lcd1602显示，以及学习verilog硬件描述语言。
- 2022-02-12 03:20:21下载
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NANDFlashcontrolandFIFOcontrol
实现NAND Flash块的控制存取以及同步的FIFO的控制 verilog 代码(NAND Flash control access and control of the synchronous FIFO verilog code)
- 2012-04-27 09:51:03下载
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CPU
C++获取CPU占用率，一个类和一个头文件(Gets the CPU Use rate)
- 2015-01-23 11:15:32下载
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FPGA数码管显示秒表实验
说明： FPGA数码管显示秒表实验
三种方法实现：
方法一： 对秒计数，得到（秒显示）0~9，
对（秒显示）计数，得到（分秒显示）0~5，
对（分秒显示）计数，得到（分钟显示）0~5，
注意进位时机
方法二： 对秒计数，得到（秒显示）0~9
对秒计数，得到（分秒显示）0~5
对秒计数，得到（分钟显示）0~5
方法三：
只对秒计数，分别取模
%60得到分钟显示 ************************
余数%10得到分秒显示 （据说）取模运算占资源！！！！（也能接受？好像...）
再剩下的余数为秒显示 ************************(Experiment of Digital Tube Display Stopwatch Based on FPGA
Three ways to achieve)
- 2020-06-22 04:40:02下载
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PCIslave代码，买开发板带的，有一定的参考价值～
买开发板带的pcislave代码，实际应用时需要改一下，看看如果有参考价值（下载的人多），后面再把其他代码也上传～～～
- 2022-03-09 21:53:22下载
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六进制
非常基础且实用的六进制加法器，采用VERILOG语言编写而成。(very common and uesfully tool--counter6, iy is writed by Verilog.)
- 2017-11-25 23:25:39下载
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