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DDS_signal_genarator
这是一个利用verilog语言编写的信号发生器的例子，值得参考(this is a code about signal generator by VIERILOG LANGUAGE!)
- 2013-12-23 10:12:52下载
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本章介绍了两个EDA技术的综合应用设计实例:数字闹钟和直接数字频率合成器DDS。...
本章介绍了两个EDA技术的综合应用设计实例:数字闹钟和直接数字频率合成器DDS。-EDA chapter describes the two technologies integrated application design example: digital alarm clock and direct digital synthesizer DDS.
- 2023-07-23 01:50:04下载
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AMBA-Bus_Verilog_Model
说明： 该源码包是2.0版本的AMBA总线的Verilog语言模型，主要包括5个部分：AHB总线仲裁器，AHB-APB总线桥接器，AHB总线上从设备ROM模型，AHB总线上从设备RAM模型，参数定义。(This source code package is the model of V2.0 AMBA bus of ARM company, It mainly includes the following five parts: the AHB arbiter,AHB-APB bridge, AHB_Rom_Slave, AHB_Ram_Slave,Defines.)
- 2021-04-25 21:48:46下载
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DE2_Basic_Computer
DE2 altera board vhdl design
- 2016-04-09 00:35:05下载
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VGA
VHDL语言实现VGA的显示彩条横条九宫格的功能。(VGA display color of the VHDL language bar Jiugongge function.)
- 2013-05-07 10:04:10下载
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Spartan 3E
这种设计允许您实验用脉冲宽度调制 （PWM） 由 PicoBlaze 处理器执行。作为提供，设计将允许您向控制 12 PWM 通道 ； 8 个通道控制板上的 8 个 Led 的强度和剩余的 4 通道上设有连接器 "J4" 你在哪
可以观察你应该对示波器的访问。你可能也喜欢尝试简单电阻电容 （RC） 平滑电路连接到接头引脚可创建附加数字信号到模拟 （D/A） 转换器或尝试控制马达通过驱动晶体管。
脉宽调制实现了 1 千赫和 8 位分辨率 （256 个步骤） 的脉冲重复频率 （PRF）。为每个 LED 或 "J4" 输出占空比可以独立使用简单的命令输入一个简单的终端程序在您的 PC 上设置 （超级终端是理想的）。
- 2023-08-09 11:30:04下载
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VHDL在SOURCEINSIGHT的插件
VHDL在SOURCEINSIGHT的插件-VHDL in SOURCEINSIGHT plug-ins
- 2022-08-13 02:07:02下载
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prac2
VHDL implementation using mouse and monitor
- 2009-06-28 20:10:56下载
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采用systemc语言设计了一个状态机，主要包括两个进程，仿真结果表明状态机可以正常工作...
采用systemc语言设计了一个状态机，主要包括两个进程，仿真结果表明状态机可以正常工作-Systemc language designed using a state machine, mainly consists of two processes, the simulation results show that the state machine can work properly
- 2022-03-17 09:47:30下载
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PWM
通过一个计数器来实现输出信号的占空比要求，可以将duty_cycle分配到拨码开关上,LED分配到发光二极管上,然后调节拨码开关,即可看到LED的亮度发生变化.(The duty cycle of the output signal can be assigned to the dial switch by a counter, and the LED can be assigned to the light emitting diode. Then the brightness of the LED can be seen by adjusting the dial switch.)
- 2020-06-16 13:20:02下载
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