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VHDL参数化浮点乘法器

于 2022-01-31 发布 文件大小:2.07 kB
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代码说明:

资源描述利用VHDL语言编写的浮点乘法器,可自定义浮点数位数,即乘数的参数化。具体为二进制有符号的浮点乘法器,二进制补码进行浮点运算。浮点数的表示是仿照IEEE格式,设置成自定义形式。

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