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密码锁
设计一个具有较高安全性和较低成本的通用电子密码锁，其具体功能要求如下: (1) 数码输入：每按下一个数字键：就输入一个数值，并在显示器上的最右方显示出该数值，同时将先前输入的数据依序左移一个数字位臵 (2) 数码清除：按下此键可清除前面所有的输入值，清除成为“0000”。 (3) 密码更改：按下此键时会将目前的数字设定成新的密码。 (4) 激活电锁：按下此键可将密码锁上锁。 (5) 解除电锁：按下此键会检查输入的密码是否正确，密码正确即开锁。
- 2022-03-20 08:56:07下载
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VHDL 编写的RAM例子
VHDL 编写的RAM例子-RAM prepared VHDL example
- 2023-03-23 05:20:03下载
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this come from alter ,you can look and find it on line about USB
this come from alter ,you can look and find it on line about USB
- 2023-09-06 16:15:03下载
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con1
4 bit convoltion with vhdl.
- 2011-10-18 18:18:09下载
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Srikanth Vijayaraghavan
Srikanth Vijayaraghavan - A Practical Guide for SystemVerilog Assertions-Srikanth Vijayaraghavan- A Practical Guide for SystemVerilog Assertions
- 2022-05-29 04:08:08下载
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is61lv25616 (1)
verilog测试，fpga测试片外sramis61lv25616，256个k个字，16位，比较难调(it is fpga is 61lv25616 simple verilog program,complete sram read and write.it can read and write .)
- 2020-12-09 15:39:18下载
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FPGA_homewrk4
设计一个能求出一个32bit字中两个相邻0之间最大间隙的电路。完成HDL设计及testbench描述，给出综合后的时序仿真结果。提交纸质文档。(Design a circuit that can find the maximum gap between two adjacent 0 in a 32bit word. The HDL design and testbench description are completed, and the result of comprehensive simulation is given. Submit paper documents.)
- 2018-05-07 17:54:12下载
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LMS自适应均衡器
在通信系统中的信道带来了重要的作用。通道可以涉及许多不同类型的扭曲我们的信息。尤其是无线信道的多径失真严重。而且更严重的是这种失真是随机的。为了解决这个问题，多渠道的影响需要在均衡器接收端。这种均衡器采用不同的学习算法连续识别通道。该项目是VHDL实现LMS学习算法流水线架构。所以这个实施可以工作以更高的数据速率以较少的时钟速度的要求，因此以较少的功耗
- 2022-01-29 00:11:01下载
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NIOS II IDE 编程， LCD测试程序，仅供参考。
NIOS II IDE 编程， LCD测试程序，仅供参考。-NIOS II programming IDE, LCD testing procedures, for information purposes only.
- 2023-03-21 17:25:03下载
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crc16_8
modbus通讯必须的校验码生成器，可以直接使用(modbus crc16/8 free use)
- 2020-10-22 10:47:23下载
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