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CPU
用Verilog实现的 哈佛结构的简单指令集CPU程序，由ALU、地址译码器、指令译码器等部分组成(Part of a simple instruction Verilog realize the Harvard architecture CPU program set by the ALU, address decoder, an instruction decoder, etc.)
- 2016-05-22 10:07:29下载
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脉冲宽度调制，编码，包括QuartusII和ModelSim工程…
脉冲宽度调制，VHDL代码编写，包括QUARTUSII和MODELSIM工程以及testbench-Pulse width modulation, VHDL coding, including QUARTUSII and ModelSim engineering and Testbench
- 2023-05-09 12:15:03下载
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project_1
简单的一个Verilog小程序，适合刚接触的人群(A simple Verilog small program, suitable for people just contact)
- 2020-06-16 22:20:01下载
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一个可综合的同步FIFO的verilog源代码
一个可综合的同步FIFO的verilog源代码-An integrated synchronous FIFO in Verilog source code
- 2022-03-26 05:23:42下载
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VHDL 快速参考手册，简要概括了VHDL，非常适合做开发参考
VHDL 快速参考手册，简要概括了VHDL，非常适合做开发参考-VHDL Quick Reference Guide, a brief summary of VHDL, is well suited to do the development of reference
- 2022-06-13 15:47:21下载
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介绍VHDL编程的资料，很详细，值得收藏
介绍VHDL编程的资料，很详细，值得收藏-vhdl
- 2023-01-26 15:25:04下载
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PCPU设计代码
RISC 5级流水线CPU，带HAZARD处理(RISC 5 pipeline CPU with HAZARD processing)
- 2020-06-24 04:00:01下载
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A4_Uart_Top
串口！ 这是一个使用的通信程序 ， 非常好用。(serial port Serial port! This is a communication program used, very useful.)
- 2020-06-17 14:00:01下载
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Altera的CycloneIII Start Board,使用的PFGA是3C25，包括原理图和PCB，用Cadence Allegro打开...
Altera的CycloneIII Start Board,使用的PFGA是3C25，包括原理图和PCB，用Cadence Allegro打开-Altera
- 2022-10-05 01:50:03下载
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can_latest.tar
用verilog编写的can总线控制器，包括设计参考历程和仿真程序，以及开发文档！(Written by verilog can bus controller, including the design reference course and simulation program, and the development of the document!)
- 2015-07-23 19:55:03下载
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