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进行选择加法器

于 2022-03-04 发布 文件大小:143.91 kB
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代码说明:

选择进位加法器是用最快的加法器中的一个。这里是进行选择加法器,添加了两个 8 位数字和一个扛在得到 9 位总和的代码。

下载说明:请别用迅雷下载,失败请重下,重下不扣分!

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  • RS-code
    说明:  我测试过的!Verilog HDL实现RS编码。(I' ve tested it! RS coding Verilog HDL implementation.)
    2010-04-12 20:30:36下载
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  • ps2_lcd
    此代码能够使得键盘控制液晶,实时的进行书写,按下Backspace清屏(This code enables the keyboard to control the LCD, in real-time writing, press Backspace clear the screen)
    2013-01-27 11:04:40下载
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  • capture-using-SCCB-and-FPGA
    利用SCCB和FPGA实现视频采集的论文,对相关开发人员具有很强的参考价值! (FPGA implementation using the SCCB and video collection of the papers, the relevant developer has a strong reference value ! )
    2013-09-29 15:37:52下载
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  • CORDIC_ATAN
    FPGA实现反正切功能,工程原件,包括测试文件,能够很好实现该功能(FPGA implements arctangent function, original engineering)
    2018-11-06 15:25:26下载
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  • uart(可综合)
    说明:  【实例简介】用Verilog实现uart串口协议,波特率可选9600、19200、38400、115200。8位数据为,1位校验位,1位停止位。 【实例截图】 【核心代码】核心代码包括TX,RX,Baud,FIFO([example introduction] UART serial port protocol is implemented with Verilog, and the baud rate can be 9600, 19200, 38400, 115200. 8-bit data, 1 bit check bit, 1 stop bit. [example screenshot] [core code] the core code includes TX, Rx, baud and FIFO)
    2020-12-08 16:00:16下载
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  • modulation-and-demodulation
    通过verilog语言实现各种基本信号的调制解调过程,包括2psk,qpsk,ppm(Realize the modulation and demodulation process of various basic signals through verilog language, including 2psk, qpsk, ppm)
    2018-04-26 21:52:04下载
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    2020-10-29 09:19:57下载
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