登录
首页 » Verilog » 简易数字钟程序(基于ALTERA quartusII)

简易数字钟程序(基于ALTERA quartusII)

于 2022-03-20 发布 文件大小:516.26 kB
0 129
下载积分: 2 下载次数: 2

代码说明:

一个简易数字钟程序,可以实现24小时精确计时、整点报时、时钟矫正、时钟复位等功能

下载说明:请别用迅雷下载,失败请重下,重下不扣分!

发表评论

0 个回复

  • 1 _ + + + d5m Nios SoC的TFT
    用DE1_SoC实现了D5M的显示,可以通过VGA和TFT屏来显示图像,将FPGA的数据传到Nios以便用C做复杂的算法处理。
    2023-02-09 00:55:10下载
    积分:1
  • I2C 的ip核与testbench
    I2C 的ip核与testbench,用verilog写的,包括master,slave reg
    2022-07-20 04:57:20下载
    积分:1
  • liyuanlnx_IP_PLL
    FPGA锁相环实验: 顶层文件加底层IP文件构成 top中例化ip核pll(Experiment of Phase-Locked Loop Based on FPGA)
    2020-06-22 04:00:01下载
    积分:1
  • verilog 多周期CPU设计
    计算机组成与设计课程设计 用verilog与FPGA设计多周期CPU 通过modelsim仿真与ISE综合
    2022-02-28 19:50:26下载
    积分:1
  • hdb3
    这是一个很全的HDB3译码的verilog程序,用于FPGA入门所用,verilog的入门很好的程序(This is a very wide of the HDB3 decoding verilog program for entry-FPGA used, verilog entry procedures for good)
    2021-04-22 16:08:48下载
    积分:1
  • endat
    endat 2.2 接口内核,发送命令至编码器或从编码器接收位置值(endat 2.2 interface cores, sending commands to the encoder or received the encoder position values)
    2021-05-12 18:30:02下载
    积分:1
  • 基于verilog的串口收发协议
    基于verilog的串口收发程序,使用组合逻辑加时序逻辑的方式编写,易于灵活修改!
    2022-09-06 08:45:02下载
    积分:1
  • CJ2
    关键词:清华大学计算机系 计算机组成原理大实验 多周期cpu工程源码,内含中断,串口,以及31个指令的实现,读写内存,控制器,ALU,寄存器,分频等模块,小作业什么的可以直接从里面摘抄,为学弟学妹造福(Keywords: Department of Computer Science Computer Composition Principle experimental multi-cycle the cpu Engineering source for the benefit of mentees)
    2020-12-29 10:09:01下载
    积分:1
  • cordic
    verilog编写的数字信号发生器NCO用CORDIC方法实现产生sin cos信号,流水线结构,简单实用。(verilog prepared by the digital signal generator NCO using CORDIC method implementation generate sin cos signal, pipelined architecture, simple and practical。)
    2021-04-09 11:38:59下载
    积分:1
  • Vending-Machine-using-Moore
    Vending Machine simulation using Moore sequence
    2016-05-30 08:24:35下载
    积分:1
  • 696516资源总数
  • 106442会员总数
  • 11今日下载