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ZHWX
DDS
产生正弦信号，OOK，AM三种波形。
使用xilinx FPGA VHDL(DDS.
Resulting in sinusoidal signal, OOK, AM three waveforms.
Using xilinx FPGA VHDL.)
- 2016-09-23 16:01:04下载
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Altera Sdram IP 源码，VHDL写的
Altera Sdram IP 源码，VHDL写的-Altera Sdram IP source code, VHDL written
- 2022-04-21 21:08:22下载
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学习应用FPGA pid实现
pid程序,新学者，使用FPGA学习，希望大家一起学习
- 2023-08-21 11:25:08下载
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quartusii 三分频电路，大家帮参考一下，有什么问题
quartusii 三分频电路，大家帮参考一下，有什么问题-one-third of quartusii frequency circuit, refer to U.S. help, have any problem
- 2022-03-17 05:41:25下载
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plldesign
pll(phase locked loop) is used to fix the circuit to particular frequency
- 2014-03-18 17:14:26下载
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数字信号处理的FPGA实现-第三版-verilog源程序
数字信号处理的FPGA实现, 包括了FPGA基础知识，浮点运算，信号处理的FIR FFT等，附录包含源代码(Digital signal processing FPGA implementation, including the basic knowledge of FPGA, floating point operations, signal processing FIR, FFT, etc., the appendix contains the source code)
- 2017-08-06 17:38:33下载
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uart
UART功能,可以增加在NIOS2內,主要來做外部Flash的擦除及寫入,需搭配上位機傳輸字串來控制(UART function, can increase the NIOS2, the main external Flash to do the erase and write, to be a string with the host computer to control the transmission)
- 2011-08-25 09:32:35下载
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de2 vga controller board can also be used for other development
de2 vga控制器，也可用于其他板子开发-de2 vga controller board can also be used for other development
- 2022-05-17 01:30:37下载
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vhdl,序列信号发生器，发出11101010，可更改为任意序列
vhdl,序列信号发生器，发出11101010，可更改为任意序列-vhdl, sequence signal generator, issued 11.10101 million, you can change an arbitrary sequence of
- 2023-08-12 03:05:03下载
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da_fir
基于FPGA分布式算法FIR滤波器verilog代码
（本人 小论文 代码，通过验证）
本文提出一种新的FIR滤波器FPGA实现方法。讨论了分布式算法原理，并提出了基于分布式算法FIR滤波器的实现方法。通过改进型分布式算法结构减少硬件资源消耗，用流水线技术提高运算速度，采用分割查找表方法减小存储规模，并在Matlab和Modelsim仿真平台得到验证。
为了节省FPGA逻辑资源、提高系统速度，设计中引入了分布式算法实现有限脉冲响应滤波器(Finite Impulse Response, FIR)。由于FIR滤波器在实现上主要是完成乘累加MAC的功能，采用传统MAC算法设计FIR滤波器将消耗大量硬件资源。而采用分布式算法 (Distributed Arithmetic, DA)，将MAC运算转化为查找表(Look-Up-Table, LUT)输出，不仅能在硬件规模上得到改善，而且更易通过实现流水线设计来提高速度。因此本文采用分布式算法设计一个可配置的FIR滤波器，并以31阶的低通FIR滤波器为例说明分布式算法滤波器结构。( FPGA verilog )
- 2020-11-10 13:49:45下载
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