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进位保存加法器

于 2022-05-19 发布 文件大小:140.88 kB
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代码说明:

16位进位加法器保存,它的Verilog代码,使用XILINX的描述和仿真,Modelsim的

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  • PiSo
    8位并行输入的数转换成串行输出,是基于高级硬件编程语言VHDL编写的。(8-bit parallel input into serial output digital conversion is based on the high-level hardware programming language VHDL prepared.)
    2020-11-30 21:59:27下载
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  • 自动售货机的Verilog
    应用背景这里的目标是设计自动售货机控制器接受资金投入(我和)在任何序列,并提供产品时所需的量已沉积并给出了改变。在这里向用户提供附加设备。这是可以撤回的如果客户希望通过按一个按钮的话,存入的钱。并;规格:1。价格的产品= rs.3。2。可能的资金的投入= 20和1。3。产品为交付时达到rs.3或RS。4。按按钮有没有(普)表示取消交易和数额的返还沉积关键技术/ *
    2022-03-19 18:10:13下载
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  • COMPLETE-OFDM
    完整的OFDM仿真程序,包括QPSK,16QAM调制,基于MATLAB,各个步骤都有详细的说明。(OFDM simulation program, based on the complete MATLAB, every step is described in detail.)
    2013-05-23 11:31:57下载
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  • UART_RX_
    说明:  fpga串口的发送程序基于verilog语言拿走不用谢。(The sending program of FPGA serial port is based on Verilog language.)
    2020-06-18 04:00:01下载
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  • FPGA 的数字闹钟
    这个项目旨在在 FPGA 上实现数字闹钟的功能。尽快 FPGA 打开时,时钟就开始了。可以使用 FPGA 板上提供 dip 开关设置报警。通过相应的 dip 开关指示灯表明了这一点。计数器保持工作,一旦报警消除,像声音放大通过扬声器蜂鸣器。 该项目是充分的。享受它吧 !
    2022-03-10 12:26:41下载
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  • turbo[1].tar
    turbo码的verilog程序,有意者请下载。(turbo code verilog procedures Interested parties please download.)
    2021-01-14 17:58:46下载
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  • AD7991_7995_7999
    AD7991_7995_7999转换器说明(4-Channel, 12-/10-/8-Bit ADC with I2C-Compatible Interface in 8-Lead SOT-23)
    2013-05-15 20:14:11下载
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  • DIGITAL-PID
    Use verilog language design DIGITAL-PID source
    2016-12-26 09:41:15下载
    积分:1
  • 脉冲检测
    数字脉冲检测序列的前端设计,利用verilog硬件描述语言进行功能设计,利用modelsim软件进行功能仿真,根据测试代码进行检测与计算,看仿真波形是否符合功能设计,在进行FPGA下载,在实验开发板上实现功能输出,完成设计。
    2022-09-25 03:55:02下载
    积分:1
  • FIFO
    Simulation and Synthesis Techniques for Asynchronous FIFO Design
    2013-08-27 16:07:08下载
    积分:1
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