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对EEPROM进行读写的verilog程序
I2C 作为一种非常通用的总线，其应用范围非常广泛，我们这里用FPGA 来做master 这种应用也非常少见，但是，我们这里要强调的是我们是通过它来学习一种接口的描述方法。
1.I2C_CTL.v 为顶层文件：
分别例化，I2C_WRITE 和 I2C_READ 两个模块。
其中因为 SDA 信号是双向信号，我们在子模块中没有定义inout 而是在顶层模块中才对此信号作三态处理。
2. 例程的功能是：产生 16 个数据（如上图起如数据是77，然后，78，79。。。。）一共16位数据一次性写入到EEPROM中。写完成后，延时100ms后启动读功能，读完16个数据后，通过串口以115200的波特率发出去。串口超级终端设置如下：baud：115200,；Hex显示，8bits数据位，1位停止位。
- 2022-01-26 03:04:55下载
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8051_VHDL
mc8051代码，里面功能齐全，调试方便(mc8051 code, inside a full-featured, easy debugging)
- 2008-03-28 14:54:19下载
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fpga实现ps2控制键盘
本实验是利用Verilog来驱动PS2，读取键盘的字母，并在lCD上显示。 本代码中只设置对键盘的字母进行检测，而对其他的没有检测。
- 2022-08-11 18:12:33下载
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基于sopc的IIC总线设计完整设计sopcIIC
该例子是基于sopc的IIC总线设计完整设计，分为硬件和软件部分，软件部分是用c语言编写的。该项目是个以完成的项目，据有较高的参考和经济价值。该例子是原来做过的项目。 整个项目是在Quartus II 7.0和nios IDE环境下开发。
(This example is based on the IIC bus design sopc complete design, divided into hardware and software, the software part is written in c language. The project is to complete the project, according to the reference and a higher economic value. The example is a project originally done. The whole project is in the Quartus II 7.0 and the nios IDE development environment.)
- 2020-07-12 00:58:53下载
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FPGA时序约束和timequest timing analyzer
约束所有时钟（包括你的设计中特有的时钟）对准确的时序分析结果而言是必不可少的。Quartus II TimeQuest Timing Analyzer为各种各样的时钟配置和典型时钟提供许多SDC命令。(Constraining all clocks, including the clocks unique to your design, is essential for accurate timing analysis results. The Quartus II TimeQuest Timing Analyzer provides many SDC commands for a variety of clock configurations and typical clocks.)
- 2018-06-06 08:26:22下载
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FPGA数字电子系统设计与开发实例导航的所有例程
应用背景在工业控制和信息通信中，i2c、usb、mac等通信技术是很频繁的通信手段，代码的好坏决定通信的是否良好，决定产品的性能。关键技术基于fpga、使用verilog语言、FPGA数字电子系统设计与开发实例导航的所有例程，包括mac、usb、i2c等，是很好的参考例子。
- 2023-06-22 22:00:04下载
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adc_dac
ADC-DAC transmittion works thru SPI on 25 MHZ. Used for some student project on Xilinx sprtan3a FPGA
- 2016-12-01 19:44:33下载
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系统设计
说明： 基于无源蜂鸣器和矩阵按键的电子琴系统设计(design of Electronic Piano System Based on Passive Buzzer and Matrix Key)
- 2020-06-21 01:20:08下载
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Key-200893142940130
说明： 关于地铁售票的一些功能 基于自动买票的VHDL设计程序 比较经典(Subway ticket on some of the features of the VHDL-based auto-buying classic design procedure)
- 2008-10-07 18:16:54下载
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SystemVerilog_For_Design_Springer_2nd_Ed_2006
SystemVerilog For Design (Springer-2nd_Ed-2006)
- 2009-10-08 02:57:28下载
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