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用数码管显示时间的数字电子钟verilog编写

于 2022-06-22 发布 文件大小:3.44 kB
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用VERILOG编写的数字电子钟,用数码管进行显示时间-VERILOG prepared with digital electronic clock with a nixie tube display time

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  • LMP
    利用LMP的20bit counter,比自带的cout进位要快的多。已经同错综合和时序仿真。-LMP
    2022-01-25 18:35:46下载
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  • Booth2_final
    该文件是booth乘法器的verilog源代码,经过最终的仿真,可以直接运行(This file is booth multiplier verilog code, after the final simulation, can be directly run)
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