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xilinx xc9572 cpld 实现的伺服电机控制器,电机控制输出,和增量编码器读取。...

于 2022-07-13 发布 文件大小:779.30 kB
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代码说明:

xilinx xc9572 cpld 实现的伺服电机控制器,电机控制输出,和增量编码器读取。-Xilinx xc9572 cpld achieve servo motor controller, motor control output, Incremental encoder and the reader.

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  • dds
    说明:  da的代码,在VHDL的编译环境下的开发。是一种集约的形式。(DA convert)
    2009-08-21 11:32:04下载
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  • TimeGen3
    能够绘制数字电路的时序图,是fpga工程师时序设计和分析的神器(for digital circuit timming design and analysis)
    2017-12-27 19:34:23下载
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  • QPSK_DDS
    说明:  Implementing QPSK using DSS
    2020-01-14 06:00:57下载
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  • cic_compiler_ds613
    说明:  国外的CIC补偿滤波器设计文件,非常有用(Abroad, CIC compensation filter design files, very useful)
    2010-03-21 13:56:49下载
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  • MapCG
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    2010-05-14 20:37:27下载
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    很有用的10bit串并转换verilog程序,需要的可以拿去参考下,在quartusII上已验证过(Useful 10bit string and convert verilog program, need to take a reference, has been verified in quartusII)
    2012-05-21 16:21:22下载
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    2010-10-08 23:12:11下载
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    这个项目修改后的展位华莱士算法给出了所需的方法来实现一种高速度和高性能并行计算的复数模拟乘法器。设计的结构使用基数 4 修改 Booth 算法和华莱士树。这两种技术来加速增殖过程,作为他们的能力,以减少局部产品代到 11/2 和压缩部分产品期限按比例为 3 ∶ 2。尽管如此,携带保存加法器 (CSA) 是用来增强系统的加法过程的速度。设计了系统有效地使用 VHDL 代码为 8 x 8 位签署数字和成功的模拟. Booth 型乘法器可以减少迭代步长,以执行乘法比较常规步骤操作次数。Booth 算法 "扫描" 乘法器操作数,并跳转到链的这种算法可以减少产生相对于常规的乘法算法,每个位的乘数乘以与被乘数和部分产品对齐和加在一起的结果所需的加法次数。更有趣的是加法次数是数据依赖
    2023-07-28 05:20:04下载
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