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Verilog入门
本文主要介绍了Verilog HDL 语言的一些基本知识，目的是使初学者能够迅速掌握HDL
设计方法，初步了解并掌握Verilog HDL语言的基本要素，能够读懂简单的设计代码并能
够进行一些简单设计的Verilog HDL建模。
缩略语清单：对本文所用缩略语进行说明，要求提供每个缩略语的英文全名和中文解释。
参考资料清单：请在表格中罗列本文档所引用的有关参考文献名称、作者、标题、编号、发布日
期和出版单位等基本信息。
- 2022-06-30 05:00:17下载
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RScoder
基于FPGA的RS编码器设计，verilog hdl语言。(RS encoder FPGA-based design, verilog hdl language.)
- 2011-07-17 22:18:08下载
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GPU_LDPC+硕士毕设论文详解
QC LDPC的编码译码 代码与论文配套 是研究生毕设 可运行 代码风格优秀(QC LDPC Coding and Decoding Code and Paper Matching are Excellent Style of Running Code for Graduate Students)
- 2021-05-14 19:30:07下载
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test-bench
如何编写测试文件，，test bench的编写方法和是列，，总结的非常好的东西(how to code test bench in verilog)
- 2012-03-31 08:38:24下载
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addsub32bit
32bit floating point addition
- 2021-04-06 18:19:02下载
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基于VGA显示的10路逻辑分析仪
FPGA 的VGA显示应用。最大采样频率100M，共十个采样通道，存储深度为每通道1024位。带时间标线，显示区域可移动。最终将波形数据显示到VGA显示器上。用Quartus ii进行设计，仿真工作。最后可在开发板上进行硬件测试。
- 2023-04-08 01:00:04下载
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关于 NIOII IO 与沟通
我有一个完整的项目 CPU Nios II 与 IO 设备之间如何进行通信：
我用 32 开关： [31:0] 作为输入设备进行通信与加利福尼亚 Nios2.And 后我使用 31 红色的 led 指示灯显示输入从开关的值。
我希望我可以帮助您了解有关与 CPU Nios2 IO 设备之间进行通信，这是一个例子，您可以开发遵循你的目的 ！
- 2022-09-20 20:25:07下载
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用Verilog语音在fpga上实现音乐计算器功能
首先根据连续运算的过程，用状态机做出键盘输入模块，然后根据原码补码的特点做出加、减、与、或、比较运算的8位ALU，之后做出将16位二进制数显示出来的显示模块，再根据连续运算流程并考虑与键盘输入的配合，做出了音乐计算器最核心的控制模块，完成输入数字的存储、运算、显示功能，最后加入音乐模块，实现全部功能。
- 2023-02-19 00:05:03下载
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top
脉冲多普勒雷达回波信号相干积累的VHDL源程序(pulse Doppler radar echo signal coherent accumulation of VHDL source)
- 2021-04-22 20:28:48下载
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ste_svpwm
实用Verilog编写的SVPWM程序，产生出SVPWM波形，可用于实现同步电机或者异步电机的空间矢量控制算法。(Practical Verilog of SVPWM written procedures, resulting in the SVPWM waveform can be used to implement the space vector control algorithm of the synchronous motor or induction motor.)
- 2021-04-18 16:58:52下载
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