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FPGA秒表

于 2023-01-19 发布文件大小:1.41 MB

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代码说明：

基于 Xilinx Spartan 6 的、在七段译码管上显示、用按键控制计时开始、结束、逐秒累加功能的verilog代码，同时它是此开发板的一个demo工程，也是中山大学移动信息工程课程作业项目之一。希望对有需要参考的孩子有所帮助

下载说明：请别用迅雷下载，失败请重下，重下不扣分！

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cordic算法，实现加减乘除、幂次方、开方的运算(CORDIC algorithm implementation, power add, subtract, multiply and divide and square root operations)

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IIR
使用verilog语言描述的二阶巴特沃斯IIR滤波器，程序中有参数说明，已经运行通过(Using verilog language to describe the second-order Butterworth IIR filter, the program has parameter description has been run through)

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my_or
verilog 或门程序初学者必备。。。。。。。。。。。。(verilog )

2009-05-26 16:07:42下载

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MAX2839寄存器配置 spi程序 &nbs

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f_adder
该工程描述的是一位全加器，可以用此作为基础，搭建多位全加器(The project description is a full adder can use this as a basis to build a number of full adder)

2013-04-21 10:30:16下载

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