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FPGA秒表

于 2023-01-19 发布 文件大小:1.41 MB
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代码说明:

基于 Xilinx Spartan 6 的、在七段译码管上显示、用按键控制计时开始、结束、逐秒累加功能的verilog代码,同时它是此开发板的一个demo工程,也是中山大学移动信息工程课程作业项目之一。希望对有需要参考的孩子有所帮助

下载说明:请别用迅雷下载,失败请重下,重下不扣分!

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  • ALU con operaciones de suma · · 雷斯塔
    》 后简单 que 准许 observar la programación de diversas funcionalidades en una ALU en verilog 的 usando instrucciones de 》 后 muy 明了。
    2022-02-11 23:41:42下载
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  • Verilog实现IIC协议
    代码属于原创,写了一天,比网传的简单明了;用Verilog语言实现的IIC通信协议,用分频计数器的方法实现SCL的输出,同样用计数器的方式确定SCL的低电平中点,在此改变SDA的值。
    2022-02-26 09:45:52下载
    积分:1
  • 归档
    ddr3使用教学(DDR3 using teaching)
    2018-03-19 09:57:19下载
    积分:1
  • verilog-lfsr-master
    说明:  Fully parametrizable combinatorial parallel LFSR/CRC module. Implements an unrolled LFSR next state computation. Includes full MyHDL testbench.
    2020-06-24 21:40:01下载
    积分:1
  • ov5640驱动代码
    ov5640的驱动代码,包括寄存器初始化,cmos图像的捕获,ddr内存的驱动,LCD驱动等。
    2022-04-30 23:32:42下载
    积分:1
  • 直方图均衡化算法
    基于FPGA的直方图均衡化算法,对灰度图像增强有较好的效果。处理图像为512x512大小。包括完整的ram模块,数据通路模块,数据处理模块。
    2022-02-06 02:41:35下载
    积分:1
  • risc
    risc(精简指令集计算机)用于更快的操作。这段代码是一个可综合的代码,可以在硬件上实现。
    2022-12-05 18:45:03下载
    积分:1
  • HDMI_FPGA
    该源码可基于FPGA设置多分辨率的HDMI显示,且其包含了完整的时序和端口、地址映射,可以很方便的将其移植(The source code can be set based on FPGA multi-resolution HDMI display, and it includes a complete timing and port, address mapping, it can be easily transplanted)
    2020-12-17 11:09:12下载
    积分:1
  • decode_64_66
    自编的64B/66B解码程序,做毕业设计的时候写的。(The decoding process 64B/66B , written when i am in the school。)
    2020-10-16 10:07:29下载
    积分:1
  • 电子时钟
    基于DE2-115的数字时钟 1.液晶显示,数码管显示 2.整点报时 3.闹钟 4.设置时间 5.设置闹钟(Digital clock based on DE2-115 1. LCD display, digital tube display 2. whole point 3. alarm clock 4. setting time 5. set the alarm clock)
    2021-03-06 23:39:29下载
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