-
52_divider
多倍（次）分频器
请注意:
本例的各个源描述的编译顺序应该是:
52_divider.vhd
52_divider_stim.vhd
(Times (times) divider Please note: This case is described in various sources to compile the order should be: 52_divider.vhd 52_divider_stim.vhd)
- 2009-09-04 09:52:18下载
- 积分：1
-
XadcMicroblaze-master
说明： 用zynq实现片内的数模转换，基于最新的zynq平台(zynq xadc on FPGA arm)
- 2020-06-21 12:00:02下载
- 积分：1
-
FFT
FFT with FIR created by students in univercity
- 2015-06-22 14:57:30下载
- 积分：1
-
TMS320DM642
学习DM642的开发板，适合DSP和pcb的初学者，容易上手(Learning DM642 development board)
- 2011-04-24 18:54:04下载
- 积分：1
-
学习Xilinx公司开发软件ISE的基础资料，从最基础到复杂逻辑设计。
学习Xilinx公司开发软件ISE的基础资料，从最基础到复杂逻辑设计。-Learning Xilinx software ISE developed the basis of information from the most basic to complex logic design.
- 2022-05-27 10:26:09下载
- 积分：1
-
FXY
说明： FPGA做波形发生器，产生8种波形，包括三角波，正弦波，锯齿波，方波等。(FPGA is used as waveform generator,Generate 8 waveforms, including triangle, sine, sawtooth, square, etc.)
- 2019-07-16 16:01:45下载
- 积分：1
-
alu
verilog code for 8 bit alu
- 2015-06-30 18:49:10下载
- 积分：1
-
Polyphase--Filter
多相抽取滤波器。分四相，两倍抽取，采用16阶FIR滤波器实现(Polyphase decimation filters. Divided into four phases, extracted twice using 16-order FIR filter implementation)
- 2020-09-10 15:58:02下载
- 积分：1
-
full adder设计代码，verilog 语言描述，通过modelsim 仿真，quartus综合...
full adder设计代码，verilog 语言描述，通过modelsim 仿真，quartus综合-full adder design code, verilog language to describe, through the ModelSim simulation, quartus integrated
- 2022-06-30 03:26:15下载
- 积分：1
-
基于vhdl的dds设计
基于vhdl的dds任意函数发生器的实现和仿真
- 2022-12-25 16:15:09下载
- 积分：1
