登录
首页 » VHDL » 一个以太网卡的硬件描述,可以参考进行设计网卡芯片。

一个以太网卡的硬件描述,可以参考进行设计网卡芯片。

于 2023-08-18 发布 文件大小:140.86 kB
0 154
下载积分: 2 下载次数: 1

代码说明:

一个以太网卡的硬件描述,可以参考进行设计网卡芯片。-an Ethernet card hardware description, reference card chip design.

下载说明:请别用迅雷下载,失败请重下,重下不扣分!

发表评论

0 个回复

  • is61lv25616 (1)
    verilog测试,fpga测试片外sramis61lv25616,256个k个字,16位,比较难调(it is fpga is 61lv25616 simple verilog program,complete sram read and write.it can read and write .)
    2020-12-09 15:39:18下载
    积分:1
  • xmatchpro无损压缩
    应用背景这个无损数据压缩系统的xmatchpro算法 衍生物;从来源 ; ;以前的研究 ; ;的 ; ;作者 ;和 ;在进步 ; ;FPGA技术。使用这种技术提供的灵活性是非常大的兴趣,因为芯片可以容易适应特定应用的要求。这个在一定的弊端; ; ; ;以前的 ;方法是 ; ;克服了 ; ;使用 ; ;  xmatchpro  ;算法;设计。的目标,然后以获得更好的压缩比,并仍然保持高吞吐量和高吞吐量,因此,这和,压缩/解压缩和,过程和,不,不,慢和,原系统的。关键技术UNIX的 ; ;实用 ;“压缩” ;采用lempel-ziv-2  ; ; ;(LZ2)算法和 ; ; ;数据Lempel-Ziv压缩 ; ; ;(dclz)的家庭 ; ;压缩机 ;最初发明 ; ;的 ;休利特—目前帕卡德和 ; ;& nbsp;通过开发 ; ;啊哈[ 17 ],[ 18 ]  ;使用也 ; ;LZ2  ;衍生物。邦顿 ;和 ;博列洛 ;另一本 ; ;LZ2  ;在实施 ; ;[ 19 ]  ;, ;提高 ;在 ;数据压缩Lempel-Ziv算法。
    2022-04-09 16:54:49下载
    积分:1
  • table-for-sin-functionof-
    DDS中的正余弦生成,初始相位相差90度,可自行改变输出频率(Cosine generation of DDS, the initial phase difference of 90 degrees, the output frequency can be changed on their own)
    2013-12-17 22:09:56下载
    积分:1
  • USB IPcoreIP核 包含文档(带说明)
    USB IPcoreIP核 包含文档(带说明)-USB IPcoreIP core includes a document (with instructions)
    2022-02-18 17:02:37下载
    积分:1
  • DDS_signal_genarator
    这是一个利用verilog语言编写的信号发生器的例子,值得参考(this is a code about signal generator by VIERILOG LANGUAGE!)
    2013-12-23 10:12:52下载
    积分:1
  • 20190717
    说明:  uart documentation, july 17, 2019. the document describes the basics of verilog programming and how to implement them on an fpga device
    2020-06-21 21:40:01下载
    积分:1
  • 一篇用VHDL实现快速傅立叶变换的论文
    一篇用VHDL实现快速傅立叶变换的论文,包括原理分析和代码实现,印度圣雄甘地大学M.A.学院提供(VHDL with a Fast Fourier Transform papers, including the principle of analysis and implementation of the code, the Mahatma Gandhi Institute of the University of Marat)
    2004-10-05 11:06:01下载
    积分:1
  • ddr3control
    8位突发长度,一次64bit数据读写,MIG核(DDR3 controll implimention)
    2021-05-07 13:58:36下载
    积分:1
  • 此示例是8051核加频率计的联合设计,带有8051IP核资料
    此示例是8051核加频率计的联合设计,带有8051IP核资料-This example is the 8051 nuclear increase the frequency of joint design, with the nuclear information 8051IP
    2022-06-14 22:57:42下载
    积分:1
  • 基于VHDL开发的自动售货机系统,可实现自动售货过程中的基本功能,具有一定的代表性。...
    基于VHDL开发的自动售货机系统,可实现自动售货过程中的基本功能,具有一定的代表性。-VHDL-based development of a vending machine system which can automatically process the basic functions of sales, with a certain representativeness.
    2022-03-24 04:11:41下载
    积分:1
  • 696516资源总数
  • 106571会员总数
  • 2今日下载