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此示例是8051核加频率计的联合设计,带有8051IP核资料

于 2022-06-14 发布 文件大小:463.55 kB
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此示例是8051核加频率计的联合设计,带有8051IP核资料-This example is the 8051 nuclear increase the frequency of joint design, with the nuclear information 8051IP

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    本例是关于卷积码的一个简单算法,用verilog HDL语言编写,整个文档包括了产生卷积的整个工程。-In this case is a convolutional code on a simple algorithm, using verilog HDL language, the entire document, including the method of deconvolution of the whole project.
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    ADI ad9361 vivado 下源代码(ADI ad9361 vivado source code)
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  • simple_cpu
    初学cpu结构的很好的verilog代码的示例,适合初学者(novice cpu structure of the good verilog code examples for beginners)
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  • GW48
    vhdl语言试验箱GW48的各种模式引脚图。。(vhdl language the various modes of chamber GW48 pin map. .)
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  • HDLstyle
    学习xilinxVHDL语言的一本好书,为官方资料,可方便读者熟悉xilinx的代码风格(A good VHDL,it s fittable for the reader to be familiar with the style of xilinx)
    2009-10-02 08:42:47下载
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  • svtb_ahb_sram
    说明:  一款verilog设计的SRAM控制器,可以实现AHB总线控制的功能。(abcdefghijklmnopqrstuvwxyz)
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