登录
首页 » VHDL » 过滤多相

过滤多相

于 2022-02-22 发布 文件大小:22.81 kB
0 48
下载积分: 2 下载次数: 1

代码说明:

我的项目执行 filtrage 和抽取使用多相分解,在这种情况下,抽取因子被带到 5,所以筛选器由 5 集团过滤器和每个 oprates 在频率采样除以 5

下载说明:请别用迅雷下载,失败请重下,重下不扣分!

发表评论

0 个回复

  • Get-20-point
    this program get 20 point from user and draw functions.
    2014-01-09 03:25:06下载
    积分:1
  • Features: Based on the VHDL language, realize high
    功能:基于VHDL语言,实现对高速A/D器件TLC5510控制-Features: Based on the VHDL language, realize high-speed A/D control devices TLC5510
    2022-11-12 08:45:02下载
    积分:1
  • SDRAM控制器源码,内含完整的控制器verilog源代码和测试代码,超值哈。...
    SDRAM控制器源码,内含完整的控制器verilog源代码和测试代码,超值哈。-This readme file for the SDR SDRAM Controller includes information that was not incorporated into the SDR SDRAM Controller White Paper v1.1.
    2023-07-19 13:10:03下载
    积分:1
  • ethernet_loopback
    通过FPGA驱动千兆以太网口,完成SPARTAN6上的UDP数据包闭环测试,即通过网口发送数据包到FPGA,FPGA内部将接收到的数据返回到PC机,建议测试之前添加ARP静态绑定,FGPA内部的IP以及MAC地址在ROM里的COE文档里可以看到,发送端添加了CRC以及整体CHECKSUM的计算(Driven by FPGA Gigabit Ethernet port, UDP SPARTAN6 data packet on the closed loop test, through the network to send data packets to FPGA, FPGA will receive the data back to the PC, the proposed test before adding ARP static binding, FGPA internal IP and MAC address in the COE document in the ROM where you can see, the sender adds CRC and CHECKSUM integral calculation)
    2017-11-20 10:21:38下载
    积分:1
  • mux
    说明:  wallance树实现8*8无符号数的相乘(Multiplication of 8 * 8 unsigned numbers by Wallace tree)
    2020-06-04 15:03:39下载
    积分:1
  • 这个是专门用在ALtera第二代PLD MAXII上的16位微处理器IP核,文档齐全...
    这个是专门用在ALtera第二代PLD MAXII上的16位微处理器IP核,文档齐全-this is the ALtera devoted second-generation PLD MAXII on the 16-bit microprocessor IP core, complete documentation
    2022-02-21 05:05:05下载
    积分:1
  • 一些有用的PicoBlaze的来源。
    Some useful PicoBlaze sources.
    2022-01-26 02:08:20下载
    积分:1
  • This book is on the Xilinx
    这本书是关于Xilinx公司开发的ISE工具的中文教程,适合于初学FPGA设计的人使用,全书内容丰富,共包括9章,通过此书的学习可以了解并掌握FPGA的设计流程及设计方法。-This book is on the Xilinx
    2022-05-14 07:46:13下载
    积分:1
  • SDI HDMI 视频转换器和发射机
    本项目接收高清 sdi 广播的视频,并将其转换为 HDMI 接口的显示器上显示。 这个项目只需要 20 位的视频数据和从它和使用标志首先 YCbCr 视频数据转换为 RGB 数据,然后编码到 HDMI 提取时间标志。 本模块需要 74.25 MHz 的时钟。
    2022-07-21 06:21:42下载
    积分:1
  • 1-Quadrature_decoder
    说明:  光栅尺FPGA调试程序,本人亲自调试保证可用(Grating ruler FPGA debugging program)
    2019-12-31 23:23:11下载
    积分:1
  • 696522资源总数
  • 104027会员总数
  • 45今日下载