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dds算法的fpga实现 altera 根据不同设置，输出不同频率的信号源...

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dds算法的fpga实现 altera 根据不同设置，输出不同频率的信号源-dds algorithm to achieve fpga set according to different altera, the output of the signal source at different frequencies

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pingpangqiu
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2014-07-04 01:42:00下载

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这个我也太清楚是什么反正师兄们说有用发大家-I am also very clear that what is useful anyway, say senior U.S. fa

2022-08-11 05:38:06下载

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E1 deframmer and Frammer.

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用于实现锁相光子计数技术的累加器，verilog语言(Accumulator achieve specific cases for accumulator lock detection of photon counting technique)

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用VHDL语言编程完成数码管0-255数字的显示-VHDL language programming with the 0-255 number to complete the display of the digital control

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使用430的四系点亮流水灯，内置有时钟函数，函数简单，值得一看(The four lines using 430 lit water lights, built-in clock function, the function is simple, eye-catcher)

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verilogexample
verilog学习资料。附带简单的源代码列子，可以直接使用和仿真。(verilog learning materials. Source code with a simple Lie Zi, and simulation can be used directly.)

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