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在vhdl开发环境下，关于协议PS2 verilog 源码

于 2022-05-06 发布文件大小:835.00 B

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在vhdl开发环境下，关于协议PS2 verilog 源码-In VHDL development environment, with regard to the agreement PS2 verilog source code

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a cycle ruduandency code
实现一个循环冗余码,是老师给的例子，别的同学已经验证-a cycle ruduandency code

2023-04-27 23:30:03下载

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2022-03-11 23:10:49下载

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Program for Code Gerneration

2011-11-13 19:14:08下载

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由于在网上很难下载到EDA技术－窦衡的PPT，所以本人经过学习后做成word，供大家下载。只针对VHDL语言部分和所有的程序。-Because the Internet is difficult to download to EDA technology- Douheng of the PPT, so I made after learning after the word, for all to download. Only for part of the VHDL language and all the procedures.

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说明： THU微纳电子系ic设计课程大作业，使用verilog实现CNN加速器，含一层卷积和池化，仿真通过。(a CNN accelerator written in VerilogHDL, including one conv layer and one pooling layer, simulation passed)

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基于FPGA的快速中值滤波算法,主要使用的语言是verilog 本文没有程序(FPGA-based fast median filtering algorithm, the main language used in this article does not process verilog)

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fm_parcial
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